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参数资料
| 型号： | IDT5T9110BBI8 |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | 5T SERIES, PLL BASED CLOCK DRIVER, 5 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PBGA144 |
| 封装： | PLASTIC, BGA-144 |
| 文件页数： | 4/23页 |
| 文件大小： | 171K |
| 代理商： | IDT5T9110BBI8 |
12
INDUSTRIALTEMPERATURERANGE
IDT5T9110
2.5V PROGRAMMABLE SKEW PLL DIFFERENTIAL CLOCK DRIVER TERACLOCK
DC ELECTRICAL CHARACTERISTICS OVER OPERATING RANGE FOR 2.5V
LVTTL(1)
Symbol
Parameter
Test Conditions
Min.
Typ.(8)
Max
Unit
Input Characteristics
IIH
Input HIGH Current
VDD = 2.7V
VI = VDDQ/GND
—
±5
μA
IIL
Input LOW Current
VDD = 2.7V
VI = GND/VDDQ
——
±5
VIK
Clamp Diode Voltage
VDD = 2.3V, IIN = -18mA
—
- 0.7
- 1.2
V
VIN
DC Input Voltage
- 0.3
+3.6
V
Single-Ended Inputs(2)
VIH
DC Input HIGH
1.7
—
V
VIL
DC Input LOW
—
0.7
V
Differential Inputs
VDIF
DC Differential Voltage(3,9)
0.2
—
V
VCM
DC Common Mode Input Voltage(4,9)
1150
1250
1350
mV
VIH
DC Input HIGH(5,6,9)
VREF + 100
—
mV
VIL
DC Input LOW(5,7,9)
—VREF - 100
mV
VREF
Single-EndedReferenceVoltage(5,9)
—
1250
—
mV
Output Characteristics
VOH
Output HIGH Voltage
IOH = -12mA
VDDQ - 0.4
—
V
IOH = -100
μAVDDQ - 0.1
—
V
VOL
Output LOW Voltage
IOL = 12mA
—
0.4
V
IOL = 100
μA
—
0.1
V
NOTES:
1. See RECOMMENDED OPERATING RANGE table.
2. For 2.5V LVTTL single-ended operation, the RxS pin is tied HIGH and
REF[1:0]/VREF[1:0] is left floating. If TxS is HIGH, FB/VREF2 should be left floating.
3. VDIF specifies the minimum input differential voltage (VTR - VCP) required for switching where VTR is the "true" input level and VCP is the "complement" input level. Differential mode
only. The DC differential voltage must be maintained to guarantee retaining the existing HIGH or LOW input. The AC differential voltage must be achieved to guarantee switching
to a new state.
4. VCM specifies the maximum allowable range of (VTR + VCP) /2. Differential mode only.
5. For single-ended operation, in differential mode,
REF[1:0]/VREF[1:0] is tied to the DC voltage VREF[1:0].
6. Voltage required to maintain a logic HIGH, single-ended operation in differential mode.
7. Voltage required to maintain a logic LOW, single-ended operation in differential mode.
8. Typical values are at VDD = 2.5V, VDDQ = VDD, +25°C ambient.
9. The reference clock input is capable of HSTL, eHSTL, LVEPECL, 1.8V or 2.5V LVTTL operation independent of the device output. (See Input/Output Selection table.)
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PDF描述 |
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