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参数资料
| 型号： | IDT5T9310NLGI |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | 5T SERIES, LOW SKEW CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQCC40 |
| 封装： | PLASTIC, QFN-40 |
| 文件页数： | 13/13页 |
| 文件大小： | 225K |
| 代理商： | IDT5T9310NLGI |
INDUSTRIALTEMPERATURERANGE
IDT5T9310
2.5VLVDS1:10CLOCKBUFFERTERABUFFERII
9
Power Down Timing
NOTES:
1. It is recommended that outputs be disabled before entering power-down mode. It is also recommended that the outputs remain disabled until the device completes power-up after
asserting PD.
2. The POWER DOWN TIMING diagram assumes that GL is HIGH.
3. It should be noted that during power-down mode, the outputs are both pulled to VDD. In the POWER DOWN TIMING diagram this is shown when Qn-Qn goes to VDIF = 0.
A1 - A1
Gx
VTHI
VIH
VIL
Qn - Qn
+VDIF
VDIF=0
-VDIF
+VDIF
VDIF=0
-VDIF
+VDIF
VDIF=0
-VDIF
PD
A2 - A2
VTHI
VIH
VIL
Differential Gate Disable/Enable Showing Runt Pulse Generation
NOTE:
1. As shown, it is possible to generate runt pulses on gate disable and enable of the outputs. It is the user's responsibility to time their Gx signals to avoid this problem.
tPLH
GL
Gx
Qn - Qn
tPGD
tPGE
VIH
VTHI
VIL
VIH
VTHI
VIL
+ VDIF
VDIF = 0
- VDIF
A[1:2] - A[1:2]
+ VDIF
VDIF = 0
- VDIF
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