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参数资料
| 型号： | IDT7014S12JG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 6/9页 |
| 文件大小： | 0K |
| 描述： | IC SRAM 36KBIT 12NS 52PLCC |
| 标准包装： | 12 |
| 格式 - 存储器： | RAM |
| 存储器类型： | SRAM - 双端口，异步 |
| 存储容量： | 36K（4K x 9） |
| 速度： | 12ns |
| 接口： | 并联 |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 52-LCC（J 形引线） |
| 供应商设备封装： | 52-PLCC（19x19） |
| 包装： | 管件 |
| 其它名称： | 7014S12JG |
IDT7014S
High-Speed 4K x 9 Dual-Port Static RAM
Industrial and Commercial Temperature Ranges
Timing Waveform of Read Cycle No. 1, Either Side (1,2)
t RC
ADDRESS
t AA
t OH
t OH
DATA OUT
PREVIOUS DATA VALID
DATA VALID
2528 drw 07
Timing Waveform of Read Cycle No. 2, Either Side (1, 3)
t AOE
OE
DATA OUT
NOTES:
t LZ
VALID DATA
t HZ
2528 drw 08
1. R/ W = V IH for Read Cycles.
2. OE = V IL .
3. Addresses valid prior to OE transition LOW.
Timing Waveform of Write with Port-to-Port Read (1,2)
t WC
ADDR "A"
MATCH
t WP
R/ W "A"
DATA IN "A"
ADDR "B"
DATA OUT "B"
t DW
t DH
VALID
MATCH
t WDD
VALID
t DDD
2528 drw 09
NOTES:
1. R/ W "B" = V IH , read cycle pass through.
2. All timing is the same for left and right ports. Port "A" may be either left or right port. Port "B" is opposite from port "A".
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相关PDF资料 |
PDF描述 |
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