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参数资料
| 型号： | IDT7038L15PFG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 13/17页 |
| 文件大小： | 0K |
| 描述： | IC SRAM 1024KBIT 15NS 120TQFP |
| 标准包装： | 12 |
| 格式 - 存储器： | RAM |
| 存储器类型： | SRAM - 双端口，异步 |
| 存储容量： | 1.125M（64K x 18） |
| 速度： | 15ns |
| 接口： | 并联 |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-TQFP（14x14） |
| 包装： | 托盘 |
IDT7038L
High-Speed 64K x 18 Dual-Port Static RAM
Waveform of Interrupt Timing (1,5)
t WC
Industrial and Commercial Temperature Ranges
ADDR "A"
INTERRUPT SET ADDRESS
(2)
t AS
(3)
t WR
(4)
CE "A"
R/ W "A"
t INS (3)
INT "B"
4837 drw 15
t RC
ADDR "B"
INTERRUPT CLEAR ADDRESS
(2)
t AS (3)
CE "B"
OE "B"
t INR (3)
INT "B"
NOTES:
1. All timing is the same for left and right ports. Port “A” may be either the left or right port. Port “B” is the port opposite from port “A”.
2. See Interrupt Truth Table.
3. Timing depends on which enable signal ( CE or R/ W ) is asserted last.
4. Timing depends on which enable signal ( CE or R/ W ) is de-asserted first.
5. Refer to Chip Enable Truth Table.
Truth Table IV — Interrupt Flag (1,4,5)
4837 drw 16
Left Port
Right Port
L
H
L
H
R/ W L
L
X
X
X
CE L
L
X
X
L
OE L
X
X
X
L
A 15L -A 0L
FFFF
X
X
FFFE
INT L
X
X
(3)
(2)
R/ W R
X
X
L
X
CE R
X
L
L
X
OE R
X
L
X
X
A 15R -A 0R
X
FFFF
FFFE
X
INT R
(2)
(3 )
X
X
Function
Set Right INT R Flag
Reset Right INT R Flag
Set Left INT L Flag
Reset Left INT L Flag
NOTES:
1. Assumes BUSY L = BUSY R =V IH .
2. If BUSY L = V IL , then no change.
3. If BUSY R = V IL , then no change.
4. INT L and INT R must be initialized at power-up.
5. Refer to Chip Enable Truth Table.
13
6.42
4837 tbl 16
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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