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参数资料
| 型号： | IDT70V631S12PRF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 16/23页 |
| 文件大小： | 0K |
| 描述： | IC SRAM 4MBIT 12NS 128TQFP |
| 标准包装： | 6 |
| 格式 - 存储器： | RAM |
| 存储器类型： | SRAM - 双端口，异步 |
| 存储容量： | 4.5M（256K x 18） |
| 速度： | 12ns |
| 接口： | 并联 |
| 电源电压： | 3.15 V ~ 3.45 V |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 128-LQFP |
| 供应商设备封装： | 128-TQFP（14x20） |
| 包装： | 托盘 |
| 其它名称： | 70V631S12PRF 800-2315 IDT70V631S12PRF-ND |
IDT70V631S
High-Speed 3.3V 256K x 18 Asynchronous Dual-Port Static RAM
Industrial and Commercial Temperature Ranges
Waveform of BUSY Arbitration Controlled by CE Timing (M/ S = V IH ) (1)
ADDR "A"
and "B"
CE "A"
CE "B"
t APS (2)
ADDRESSES MATCH
t BAC
t BDC
BUSY "B"
5622 drw 14
Waveform of BUSY Arbitration Cycle Controlled by Address Match
Timing (M/ S = V IH ) (1)
ADDR "A"
ADDR "B"
ADDRESS "N"
t APS (2)
MATCHING ADDRESS "N"
t BAA
t BDA
BUSY "B"
5622 drw 15
NOTES:
1. All timing is the same for left and right ports. Port “A” may be either the left or right port. Port “B” is the port opposite from port “A”.
2. If t APS is not satisfied, the BUSY signal will be asserted on one side or another but there is no guarantee on which side BUSY will be asserted.
AC Electrical Characteristics Over the
Operating Temperature and Supply Voltage Range
70V631S10
Com'l Only
70V631S12
Com'l
& Ind
70V631S15
Com'l
Symbol
Parameter
Min.
Max.
Min.
Max.
Min.
Max.
Unit
INTERRUPT TIMING
t AS
t WR
t INS
t INR
Address Set-up Time
Write Recovery Time
Interrupt Set Time
Interrupt Reset Time
0
0
____
____
____
____
10
10
0
0
____
____
____
____
12
12
0
0
____
____
____
____
15
15
ns
ns
ns
ns
5622 tbl 15
16
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PDF描述 |
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参数描述 |
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