参数资料
型号: IDT72261LA20TFI8
厂商: IDT, Integrated Device Technology Inc
文件页数: 27/27页
文件大小: 0K
描述: IC FIFO 8192X18 LP 20NS 64QFP
标准包装: 1,250
系列: 7200
功能: 同步
存储容量: 144K(8K x 18)
数据速率: 50MHz
访问时间: 20ns
电源电压: 4.5 V ~ 5.5 V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 64-LQFP
供应商设备封装: 64-TQFP(10x10)
包装: 带卷 (TR)
其它名称: 72261LA20TFI8
9
COMMERCIALANDINDUSTRIAL
TEMPERATURERANGES
IDT72261LA/72271LA SuperSync FIFO
16,384 x 9 and 32,768 x 9
Figure 4. Programmable Flag Offset Programming Sequence
Figure 3. Offset Register Location and Default Values
EMPTY OFFSET (LSB) REG.
8
7
0
EMPTY OFFSET (MSB) REG.
00H
85
0
IDT72261LA
16,384 x 9 BIT
FULL OFFSET (LSB) REG.
8
7
0
FULL OFFSET (MSB) REG.
00H
85
0
DEFAULT VALUE
07FH if
LD is LOW at Master Reset
3FFH if
LD is HIGH at Master Reset
DEFAULT VALUE
07FH if
LD is LOW at Master Reset
3FFH if
LD is HIGH at Master Reset
4671 drw 06
IDT72271LA
32,768 x 9 BIT
EMPTY OFFSET (LSB) REG.
8
7
0
EMPTY OFFSET (MSB) REG.
00H
86
0
FULL OFFSET (LSB) REG.
8
7
0
FULL OFFSET (MSB) REG.
00H
86
0
DEFAULT VALUE
07FH if
LD is LOW at Master Reset
3FFH if
LD is HIGH at Master Reset
DEFAULT VALUE
07FH if
LD is LOW at Master Reset
3FFH if
LD is HIGH at Master Reset
NOTES:
1. The programming method can only be selected at Master Reset.
2. Parallel reading of the offset registers is always permitted regardless of which programming method has been selected.
3. The programming sequence applies to both IDT Standard and FWFT modes.
WCLK
RCLK
Selection
X
Parallel write to registers:
Empty Offset (LSB)
Empty Offset (MSB)
Full Offset (LSB)
Full Offset (MSB)
X
Parallel read from registers:
Empty Offset (LSB)
Empty Offset (MSB)
Full Offset (LSB)
Full Offset (MSB)
X
No Operation
X
Write Memory
X
Read Memory
X
No Operation
4671 drw 07
LD
0
X
1
0
WEN
0
1
0
X
1
REN
1
0
1
X
0
1
X
Serial shift into registers:
28 bits for the 72261LA
SEN
1
X
0
30 bits for the 72271LA
1 bit for each rising WCLK edge
Starting with Empty Offset (LSB)
Ending with Full Offset (MSB)
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