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参数资料
| 型号： | IDT72V2105L15PFI |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | FIFO |
| 英文描述： | 3.3 VOLT HIGH DENSITY CMOS SUPERSYNC FIFO 131,072 x 18 262,144 x 18 |
| 中文描述： | 256K X 18 OTHER FIFO, 10 ns, PQFP64 |
| 封装： | PLASTIC, TQFP-64 |
| 文件页数： | 13/26页 |
| 文件大小： | 294K |
| 代理商： | IDT72V2105L15PFI |
20
COMMERCIAL AND INDUSTRIAL TEMPERATURE RANGES
IDT72V295/72V2105 3.3V HIGH DENSITY CMOS
SUPERSYNC FIFOTM 131,072 x 18, 262,144 x 18
NOTES:
1. Retransmit setup is complete after
EF returns HIGH, only then can a read operation begin.
2.
OE = LOW.
3. W1 = first word written to the FIFO after Master Reset, W2 = second word written to the FIFO after Master Reset.
4. No more than D - 2 may be written to the FIFO between Reset (Master or Partial) and Retransmit setup. Therefore,
FF will be HIGH throughout the Retransmit setup procedure.
D = 131,072 for IDT72V295 and 262,144 for IDT72V2105.
5. There must be at least two words written to the FIFO before a Retransmit operation can be invoked.
Figure 11. Retransmit Timing (IDT Standard Mode)
tREF
tRTS
tENH
4668 drw 14
tA
tENS
Wx
WCLK
RCLK
REN
RT
EF
PAF
HF
PAE
Q0 - Qn
tSKEW2
12
1
W1(3)
tPAF
tHF
tPAE
tREF
Wx+1
2
W2(3)
tENH
WEN
tENS
tRTS
tENS
tENH
tA
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