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参数资料
| 型号： | IDT72V3611L20PF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 18/19页 |
| 文件大小： | 0K |
| 描述： | IC FIFO SYNC 64X36 20NS 120-TQFP |
| 标准包装： | 45 |
| 系列： | 72V |
| 功能： | 同步 |
| 存储容量： | 2.3K（64 x 36） |
| 数据速率： | 50MHz |
| 访问时间： | 20ns |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 120-LQFP |
| 供应商设备封装： | 120-TQFP（14x14） |
| 包装： | 托盘 |
| 其它名称： | 72V3611L20PF |
8
IDT72V3611 3.3V, CMOS SyncFIFOTM
64 x 36
COMMERCIALTEMPERATURERANGE
SWITCHING CHARACTERISTICS OVER RECOMMENDED RANGES OF SUPPLY
VOLTAGE AND OPERATING FREE-AIR TEMPERATURE, CL = 30 pF
IDT72V3611L15
Symbol
Parameter
Min.
Max.
Unit
fS
Clock Frequency, CLKA or CLKB
–
66.7
MHz
tA
Access Time, CLKB
↑toB0-B35
2
10
ns
tWFF
Propagation Delay Time, CLKA
↑ to FF
210
ns
tREF
Propagation Delay Time, CLKB
↑ to EF
210
ns
tPAE
Propagation Delay Time, CLKB
↑ to AE
210
ns
tPAF
Propagation Delay Time, CLKA
↑ to AF
210
ns
tPMF
Propagation Delay Time, CLKA
↑ to MBF1 LOW or
1
9
ns
MBF2 HIGH and CLKB
↑ to MBF2 LOW or MBF1 HIGH
tPMR
Propagation Delay Time, CLKA
↑ to B0-B35(1) and CLKB↑ to A0-A35(2)
210
ns
tMDV
Propagation Delay Time, MBB to B0-B35 Valid
1
10
ns
tPDPE
Propagation Delay Time, A0-A35 Valid to PEFA
210
ns
Valid; B0-B35 Valid to PEFB Valid
tPOPE
Propagation Delay Time, ODD/EVEN to PEFA and PEFB
210
ns
tPOPB(3)
Propagation Delay Time, ODD/EVEN to Parity Bits
2
10
ns
(A8, A17, A26, A35) and (B8, B17, B26, B35)
tPEPE
Propagation Delay Time, CSA, ENA, W/RA, MBA, or
1
10
ns
PGA to PEFA; CSB, ENB, W/RB, MBB, or PGB to PEFB
tPEPB(3)
Propagation Delay Time, CSA, ENA W/RA, MBA, or PGA to Parity Bits (A8, A17,
2
10
ns
A26, A35); CSB, ENB, W/RB, MBB, or PGB to Parity Bits (B8, B17, B26, B35)
tRSF
Propagation Delay Time, RST to AE LOW and (AF, MBF1, MBF2) HIGH
1
15
ns
tEN
Enable Time, CSA and W/RA LOW to A0-A35 Active
2
10
ns
and CSB LOW and W/RB HIGH to B0-B35 Active
tDIS
Disable Time, CSA or W/RA HIGH to A0-A35 at high impedance
1
9
ns
and CSB HIGH or W/RB LOW to B0-B35 at high impedance
NOTES:
1. Writing data to the mail1 register when the B0-B35 outputs are active and MBB is HIGH.
2. Writing data to the mail2 register when the A0-A35 outputs are active and MBA is HIGH.
3. Only applies when reading data from a mail register.
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PDF描述 |
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| IDT72V261LA20PF8 | IC FIFO SS 8192X18 20NS 64QFP |
相关代理商/技术参数 |
参数描述 |
|---|---|
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