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参数资料
| 型号： | IDT72V3612L20PQF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 8/24页 |
| 文件大小： | 0K |
| 描述： | IC FIFO 64X36X2 20NS 132QFP |
| 标准包装： | 36 |
| 系列： | 72V |
| 功能： | 异步 |
| 存储容量： | 4.6K（64 x 36 x2） |
| 数据速率： | 50MHz |
| 访问时间： | 20ns |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 132-BQFP 缓冲式 |
| 供应商设备封装： | 132-PQFP（24.13x24.13） |
| 包装： | 托盘 |
| 其它名称： | 72V3612L20PQF |
16
IDT72V3612 3.3V, CMOS SyncBiFIFOTM
64 x 36 x 2
COMMERCIALTEMPERATURERANGE
NOTE:
1. tSKEW1 is the minimum time between a rising CLKB edge and a rising CLKA edge for EFA to transition HIGH in the next CLKA cycle. If the time between the rising CLKB edge and
rising CLKA edge is less than tSKEW1, then the transition of EFA HIGH may occur one CLKA cycle later than shown.
Figure 8. EFA
EFA
EFA Flag Timing and First Data Read when FIFO2 is Empty
CSB
W/
RB
MBB
FFB
B0 - B35
CLKA
EFA
CSA
W/
RA
MBA
ENB
ENA
A0 -A35
CLKB
12
4659 drw 11
tCLKH
tCLKL
tCLK
tENS3
tENS2
tENH3
tENH2
tDS
tDH
tSKEW1
tCLK
tCLKL
tENS2
tENH2
tA
W1
FIFO2 Empty
LOW
HIGH
LOW
tCLKH
W1
HIGH
(1)
tREF
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