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参数资料
| 型号： | IDT72V51246L7-5BB |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 22/56页 |
| 文件大小： | 0K |
| 描述： | IC FLOW CTRL MULTI QUEUE 256-BGA |
| 标准包装： | 1 |
| 类型： | 多队列流量控制 |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-BBGA |
| 供应商设备封装： | 256-BGA（17x17） |
| 包装： | 托盘 |
| 其它名称： | 72V51246L7-5BB |
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29
COMMERCIALANDINDUSTRIAL
TEMPERATURERANGES
IDT72V51236/72V51246/72V51256 3.3V, MULTI-QUEUE FLOW-CONTROL DEVICES
(4 QUEUES) 36 BIT WIDE CONFIGURATION 589,824, 1,179,648 and 2,359,296 bits
FF
tRSF
OV
tRSF
PAF
tRSF
PAE
tRSF
PR
tRSF
Qn
tRSF
LOGIC "1" if
OE is LOW and device is Master
HIGH-Z if
OE is HIGH or Device is Slave
HIGH-Z if Slave Device
LOGIC “0" if Master Device
LOGIC "1" if Master Device
HIGH-Z if Slave Device
LOGIC "1" if Master Device
HIGH-Z if Slave Device
LOGIC "0" if Master Device
HIGH-Z if Slave Device
LOGIC "0" if Master Device
LOGIC "1" if Master Device
HIGH-Z if Slave Device
LOGIC "1" if Master Device
HIGH-Z if Slave Device
LOGIC "1" if Master Device
HIGH-Z if Slave Device
PAFn
PAEn
PRn
tRS
MRS
WEN
REN
tRSS
FSTR,
ESTR
5937 drw09
tRSR
SENI
WADEN,
RADEN
tRSS
OW, IW,
BM
DF
FM
HIGH = Looped
LOW = Strobed (Direct)
ID0, ID1,
ID2
tRSS
HIGH = Packet Ready Mode
LOW = Almost Empty
MAST
PKT
DFM
HIGH = Master Device
LOW = Slave Device
HIGH = Default Programming
LOW = Serial Programming
HIGH = Offset Value is 128
LOW = Offset value is 8
tRSS
Figure 4. Master Reset
NOTES:
1.
OE can toggle during this period.
2.
PRS should be HIGH during a MRS.
相关PDF资料 |
PDF描述 |
|---|---|
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| IDT72V51446L7-5BB8 | IC FLOW CTRL MULTI QUEUE 256-BGA |
| LFECP10E-3FN484I | IC FPGA 10.2KLUTS 484FPBGA |
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参数描述 |
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