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参数资料
| 型号： | IDT72V71623BC |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 28/28页 |
| 文件大小： | 0K |
| 描述： | IC DGTL SW 2048X2048 144-BGA |
| 标准包装： | 14 |
| 系列： | 72V |
| 类型： | 多路复用器 |
| 电路： | 1 x 1:16 |
| 独立电路： | 1 |
| 电压电源： | 单电源 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 144-LBGA |
| 供应商设备封装： | 144-CABGA（13x13） |
| 包装： | 托盘 |
| 其它名称： | 72V71623BC |
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9
COMMERCIAL TEMPERATURE RANGE
IDT72V71623 3.3V TIME SLOT INTERCHANGE
DIGITAL SWITCH 2,048 x 2,048
Figure 1. Constant Delay Mode Examples
1Frame(125
sec)
1Frame(125
sec)
1Frame(125
sec)
RX 2 Mb/s
A
Q
TX 16 Mb/s
Q(1)
A(2)
DR3-0 = 9H
NOTES:
1. Timeslot Q
2 Frames minimum delay.
2. Timeslot A
3 Frames - 1 output channel period maximum delay.
1 Channel @ 2 Mb/s
AB
C
D
E
F
RX 2 Mb/s
Figure 2. Variable Delay Mode Examples
TX 8 Mb/s
RX 16 Mb/s
TX 8 Mb/s
A or B(1,2)
C or D
DR3-0 = 4H(3)
NOTES:
1. If data is switched at least +3 channel periods of the slower data rate, the data will transmit out in the same frames except if the input and output data rates are both 16 Mb/s
(DR3-0 = 0x3).
2. Delay is a function of input channel and output channel combinations, and input and output stream data rate.
3. See switching mode table for input and output speed combinations.
4. When the input and output data rates are both 16 Mb/s, the minimum delay achievable is 6 time slots.
2 Mb/s
→ 8 Mb/s
1 Channel @ 8 Mb/s
A(1,2)
DR3-0 = AH(3)
AB
C
D
E
F
G
H
I
J
1 Channel @ 8 Mb/s
1 Channel @ 16 Mb/s
2 Mb/s
→ 16 Mb/s
16 Mb/s
→ 8 Mb/s
RX 16 Mb/s
DR3-0 = 3H(3,4)
AB
C
D
E
F
G
H
I
J
K
L
M
N
O
P
Q
R
TX 16 Mb/s
ABBBA
16 Mb/s
→ 16 Mb/s
相关PDF资料 |
PDF描述 |
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| IDT72V71623DAG | IC DGTL SW 2048X2048 144-TQFP |
相关代理商/技术参数 |
参数描述 |
|---|---|
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