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参数资料
| 型号： | IDT79RC32T351-133DHG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 26/42页 |
| 文件大小： | 0K |
| 描述： | IC MPU 32BIT CORE 133MHZ 208-QFP |
| 产品变化通告： | Product Discontinuation 07/Dec/2009 |
| 标准包装： | 24 |
| 系列： | Interprise™ |
| 处理器类型： | RISC 32-位 |
| 速度： | 133MHz |
| 电压： | 2.5V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 208-BFQFP |
| 供应商设备封装： | 208-PQFP（28x28） |
| 包装： | 托盘 |
| 其它名称： | 79RC32T351-133DHG |
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May 25, 2004
IDT 79RC32351
Table 13 JTAG AC Timing Characteristics
Figure 17 JTAG AC Timing Waveform
Signal
Symbol
Reference
Edge
100MHz
133MHz
Unit
Conditions
Timing
Diagram
Reference
Min
Max
Min
Max
EJTAG and JTAG
JTAG_TCK
Tperiod1
none
100
—
100
—
ns
Thigh1,Tlow1
40
—
40
—
ns
Trise1,Tfall1
—
5
—
5
ns
EJTAG_DCLK1
1. EJTAG_DCLK is equal to the internal CPU pipeline clock.
Tperiod2
none
10.0
7.5
10.0
ns
Thigh2,Tlow2
2.5
—
2.5
—
ns
Trise2,Tfall2
—
3.5
—
3.5
ns
JTAG_TMS, JTAG_TDI,
JTAG_TRST_N
Tsu3
JTAG_TCK rising
3.0
—
3.0
—
ns
Thld3
1.0
—
1.0
—
ns
JTAG_TDO
Tdo4
JTAG_TCK falling
2.0
12.0
2.0
12.0
ns
Tdo5
EJTAG_DCLK rising -0.72
2. A negative delay denotes the amount of time before the reference clock edge.
1.0
-0.72
1.0
ns
JTAG_TRST_N
Tpw6
none
100
—
100
—
ns
Tsu6
JTAG_TCK rising
2
—
2
—
ns
EJTAG_PCST[2:0]
Tdo7
EJTAG_DCLK rising -0.32
3.3
-0.32
3.3
ns
Tperiod1
Tfall1
Tlow1
Thigh1
Trise2
Tfall2
Thigh2
Tlow2
Tsu3
Thld3
Tdo4
Tperiod2
Trise1
Tdo5
Tdo7
Tsu6
Tpw6
JTAG_TCK
EJTAG_DCLK
JTAG_TMS,
JTAG_TDI
JTAG_TDO
EJTAG_PCST
JTAG_TRST_N
TPC
TDO
PCST
EJTAG TPC, TCST capture
EJTAG_TRST_N
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