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参数资料
| 型号： | IDT82V2604BBG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 5/97页 |
| 文件大小： | 0K |
| 描述： | IC INVERSE MUX 4CH ATM 208-BGA |
| 标准包装： | 1 |
| 应用： | 无线 |
| 接口： | Utopia |
| 电源电压： | 2.97 V ~ 3.63 V |
| 封装/外壳： | 208-BGA |
| 供应商设备封装： | 208-PBGA（17x17） |
| 包装： | 托盘 |
| 安装类型： | 表面贴装 |
| 其它名称： | 82V2604BBG |
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PIN DESCRIPTION
13
December 4, 2006
IDT82V2604
Inverse Multiplexing for ATM
RxAddr4
RxAddr3
RxAddr2
RxAddr1
RxAddr0
C14
C15
C16
D13
D14
I
RxAddr[4:0]: Utopia Receive Address
Utopia receive port address driven from the ATM layer to poll and select an appropriate port.
The RxAddr[4:0] input bus are sampled on the rising edge of RxClk.
RxData7
RxData6
RxData5
RxData4
RxData3
RxData2
RxData1
RxData0
A15
B14
A14
C13
B13
A13
D12
C12
High-Z
O
RxData[7:0]: Utopia Receive Data
Utopia 8-bit data bus driven from the IDT82V2604 to the ATM layer.
The RxData[7:0] output bus are updated on the rising edge of RxClk.
RxClav
B16
High-Z
O
RxClav: Utopia Receive Cell Available
Utopia cell available signal. A polled port drives RxClav only during each cycle following one with its
address on the RxAddr lines. The polled port asserts RxClav high to indicate its corresponding FIFO
has a complete cell available for transfer to the ATM layer, otherwise it deasserts the signal.
The RxClav output is updated on the rising edge of RxClk.
Note: This pin requires a pull-down resistor.
RxSOC
B15
High-Z
O
RxSOC: Utopia Receive Start of Cell
Utopia start of cell pulse. It will be driven high when RxData[7:0] contain the first valid byte of a cell.
The RxSOC input is updated on the rising edge of RxClk.
T1/E1 Line Interface
TSD4
TSD3
TSD2
TSD1
R7
R8
R9
R10
O
TSDn: Transmit Side Data Output
TSDn contains the transmit data for the n-th link.
The TSDn output is updated on the rising edge of TSCKn or TSCCK if common clock is used.
TSCK4
TSCK3
TSCK2
TSCK1
T7
T8
P9
P10
I
TSCKn: Transmit Side Clock
TSCKn contains the transmit clock for the n-th link.
Note: If unused, TSCKn should be connected to ground.
TSF4
TSF3
TSF2
TSF1
P8
T9
T10
T11
I
TSFn: Transmit Side Frame pulse
TSFn is used to delineate each frame for the n-th link.
The TSFn input is sampled on the falling edge of TSCKn or TSCCK if common clock is used.
Note: If unused, TSFn should be connected to ground.
TSCCK
P1
I
TSCCK: Transmit Side Common Clock
TSCCK is the transmit clock for links that are configured in Common Clock Mode.
Note: If unused, TSCCK should be connected to ground.
TSCFS
P2
I
TSCFS: Transmit Side Common Frame Pulse
This signal is used to delineate each frame for links that are configured in Common Clock Mode.
The TSCFS input is sampled on the falling edge of TSCCK.
Note: If unused, TSCFS should be connected to ground.
Table-1 Pin Description (Continued)
Name
Pin Number
Input/Output
Description
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PDF描述 |
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