参数资料
型号: IDTCV126PVG8
厂商: INTEGRATED DEVICE TECHNOLOGY INC
元件分类: 时钟产生/分配
英文描述: 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
封装: GREEN, SSOP-56
文件页数: 15/15页
文件大小: 85K
代理商: IDTCV126PVG8
COMMERCIALTEMPERATURERANGE
IDTCV126
PROGRAMMABLEFLEXPCCLOCKFORP4PROCESSOR
9
Symbol
Parameter
Test Conditions
Min.
Typ.
Max.
Unit
VIH
Input HIGH Voltage
3.3V ± 5%
2
VDD + 0.3
V
VIL
Input LOW Voltage
3.3V ± 5%
VSS - 0.3
0.8
V
VIH_FS
LOW Voltage, HIGH Threshold
For FSA.B.C test_mode
0.7
VDD + 0.3
V
VIL_FS
LOW Voltage, LOW Threshold
For FSA.B.C test_mode
VSS - 0.3
0.35
V
IIL
Input LeakageCurrent
0< VIN < VDD, no internal pull-up or pull-down
–5
+5
μA
IDD3.3OP
Operating Supply Current
Full active, CL = full load
400
mA
IDD3.3PD
Powerdown Current
All differential pairs driven
70
mA
All differential pairs tri-stated
12
FI
Input Frequency(1)
VDD = 3.3V
14.31818
MHz
LPIN
Pin Inductance(2)
——
7
nH
CIN
Logic inputs
5
COUT
Input Capacitance(2)
Output pin capacitance
6
pF
CINX
XTAL_IN and XTAL_OUT pins
5
TSTAB
Clock Stabilization(2,3)
From VDD power-up or de-assertion of PD to first clock
1.8
ms
Modulation Frequency(2)
Triangular modulation
30
33
KHz
TDRIVE_PD(2)
CPU output enable after PD de-assertion
300
us
TFALL_PD(2)
Fall time of PD
5
ns
TRISE_PD(2)
Rise time of PD
5
ns
ELECTRICAL CHARACTERISTICS - INPUT / SUPPLY / COMMON OUTPUT
PARAMETERS
Following Conditions Apply Unless Otherwise Specified:
Operating Condition: TA = 0°C to +70°C, Supply Voltage: VDD = 3.3V ± 5%
NOTES:
1.
Input frequency should be measured at the REF output pin and tuned to ideal 14.31818MHz to meet ppm frequency accuracy on PLL outputs.
2.
This parameter is guaranteed by design, but not 100% production tested.
3.
See TIMING DIAGRAMS for timing requirements.
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PDF描述
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参数描述
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