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参数资料
| 型号： | ISL5239 |
| 厂商： | Intersil Corporation |
| 英文描述： | Pre-Distortion Linearizer |
| 中文描述： | 预失真线性化电路 |
| 文件页数： | 3/31页 |
| 文件大小： | 653K |
| 代理商： | ISL5239 |
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3
Functional Block Diagram
IOUT<17:0>
QOUT<17:0>
ISL5239 Pre-Distortion Linearizer
M
CHANNEL 3
MEMORY EFFECT
COMPENSATION
QIN<17:0>
IIN<17:0>
HALF
BAND
FILTER
1
HALF
BAND
FILTER
2
HALF
BAND
FILTER
3
20
/
20
/
18
/
/
BYPASS
BYPASS
BYPASS
OFFSET
BINARY
ISTRB
DE-MUX
INPUT TYPE
(PAR/SERIAL)
/
/
Q
I
I
BYPASS
Q
I
CM TEST
P
EFFECTS
FPGA
FUNC. SEL.
OFFSET
SCALE
PD MAG.
POWER
INTEGRATOR
LUT
PWR INTGR PER.
PWR LOW
PWR HIGH
PAR. TO SERIAL
SER. OUTPUT EN.
LUT DATA I
LUT DATA Q
LUT DELTA DATA I
LUT DELTA DATA Q
ACTIVE LUT
LUT ADDR
LUT ADDR AUTO INCR.
MEMORY
ADDR
P
SERCLK
SERSYNC
SEROUT
SERIAL TO PAR.
SERIN
SERIAL INPUT EN.
COEF. B SELECT
COEF. A
COEF. B
DATA
LUT
ADDRESS
CALCULATION
TEST
CORRECTION
FILTER
REAL 1X
REAL 2X
COMPLEX
GAIN /
PHASE
OFFSET
ADJUST.
OUTPUT
DATA
FORMATTER
8-18 BIT-WIDTH
MEMORY SELECT
FB DELAY COUNT
uP INTERFACE
INPUT
CAPTURE
MEMORY 2K
ADDR
DATA
FEEDBACK
CAPTURE
MEMORY 1K
FORMAT
FB<19:0>
FBCLK
uP
FB
STATE
TRIG
DATA
ADDR
INPUT
STATE
uP
INPUT
SEL
IFIP I,Q
PD I,Q
PD MAG.
TRIGIN
uP
TRIG SEL
INPUT DELAY
COUNT
CM TEST I,Q
A<5:0>
P<15:0>
CS
WR
RD
BUSY
RESET
CLK
TRIGOUT
CLKOUT
JTAG
TMS
TDI
TCK
TRST
TDO
COEF. ADDR.
COEF. DATA
OUTPUT WORD WIDTH SEL.
OUTPUT VALUE TYPE
HM, KM, LM, GM, DC OFFSETS
IF
CONV.
MODE
BYPASS
BYPASS
BYPASS
THRESHOLD
COMPARE
PD MAG.
MAX
MIN
IFIP I,Q
P
I
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