参数资料
| 型号： | ISL6617IRZ |
| 厂商： | Intersil |
| 文件页数： | 10/15页 |
| 文件大小： | 0K |
| 描述： | IC PWM DOUBLER MONITOR 10DFN |
| 标准包装： | 100 |
| 应用： | PWM Doubler |
| 电流 - 电源： | 6mA |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | * |
| 封装/外壳： | * |
| 供应商设备封装： | * |
| 包装： | * |
ISL6617
19%*R
VCC
ISL6617
INTERLEAVING
0ns TO 70ns
28.5%*R
EN_PH_ SYNC
+
-
4 CYCLES
BLANKING
INTERLEAVING
+120+(0ns TO 70ns)
+
SYNC
52.5%*R
-
-
+
SYNC
0ns TO 70ns
TTL
+
-
EN_PH
FIGURE 7. CONFIGURATION FOR TRANSITION BETWEEN SYNCHRONOUS AND INTERLEAVING #2 MODES
ISL6617/ISL6611A
PWMA PWM1A
PHASE1A
VCC
EN_X
ISENA
ISL6617
PWMA
PWMIN
PWM1
PWMA
ISENA
IOUT
PWMB
ISENB
PWM1B
PHASE1B
PWMIN
VOUT
IOUT
PWMB
PWMB
PWMA
PWM1C
PHASE1C
ISENB
PWMIN
ISENA
VCC
IOUT
EN_X
PWMB
ISENB
PWM1D
PHASE1D
ISL6617/ISL6611A
FIGURE 8. CASCADED PHASE DOUBLER SIMPLIFIED DIAGRAM
The ISL6617 can further be cascaded with itself or
ISL6611A (phase doubler with integrated 5V drivers), as
shown in Figure 8. This can quadruple the number of
TABLE 2. CONTROLLER FREQUENCY AND MAXIMUM
DUTY CYCLE
phase each PWM line can support. Figure 9 shows the
operational waveforms of the cascaded doublers. The
PWMIN pin will be pulled to VCC when the doubler is
disabled (EN_x = Low). To avoid driving the PWM outputs
of the 1st stage ISL6617 by the 2nd stage’s PWMIN, the
2nd stage doubler’s enable input should remain high, i.e,
OPERATIONAL
MODES F CONTROLLER
Interleaving 2 x F SW
ISL6617
MAXIMUM
DUTY CYCLE
PER PHASE
50%
D MAX
WITH
ISL6336G
45%
tied to VCC, as shown in Figure 8.
To operate each phase at the switching frequency of F SW ,
the operational frequency of the controller needs to be
Synchronous
Cascaded
Interleaving
F SW
4 x Fsw
100%
25%
90%
22.5%
scaled accordingly for different modes, as shown in
Table 2.
10
FN7564.0
February 4, 2010
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PDF描述 |
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