参数资料
| 型号： | ISLA224S25IR1Z |
| 厂商： | Intersil |
| 文件页数： | 17/38页 |
| 文件大小： | 0K |
| 描述： | IC ADC |
| 标准包装： | 1 |
| 系列： | * |
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ISLA224S
24
FN7911.2
April 25, 2013
NOTES:
16. The JESD204 parameters are shown as their actual values, with the JESD204 encoded values (i.e., the values that are programmed into the SPI
registers) in the next column over. Typically values that must always be greater than 1 are encoded as value minus 1, and so on.
17. Frame map format decoder: "CxSy[a:b]" = Converter x, Sample y, bits a through b. For example, "C0S0[13:6]" = Converter 0, Sample 0, bits 13 through
6, etc. "T" = Tail bit (information-less bit packed in the transport layer mapping to form octets).
18. The topmost lane in the graphical frame map is Lane0, followed by Lane1 and Lane 2 (for 3-lane configurations).
TABLE 5. JESD204 PARAMETERS (Continued)
PACKING
MODE
NUMBER
OF LANES
JESD204
PARAMETER ENCODED
JESD204 PARAMETERS AND FRAME MAP (Notes 16, 17, 18)
FIGURE 52. MSB-FIRST ADDRESSING
CSB
SCLK
SDIO
R/W
W1
W0
A12
A11
A1
A0
D7
D6
D5
D4
D3
D2
D1
D0
A10
FIGURE 53. LSB-FIRST ADDRESSING
CSB
SCLK
SDIO
R/W
W1
W0
A12
A11
A1
A0
D7
D6
D5
D4
D3
D2
D1
D0
A2
FIGURE 54. SPI WRITE
tS
tHI
tCLK
tLO
R/W
W1
W0
A12
A11
A10
A9
A8
A7
D5
D4
D3
D2
D1
D0
tH
tDHW
tDSW
SPI WRITE
CSB
SCLK
SDIO
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PDF描述 |
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参数描述 |
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| ISLA224S25IR48EV1Z | 制造商:INTERSIL 制造商全称:Intersil Corporation 功能描述:Dual 12-Bit, 250/200/125 MSPS JESD204B High Speed Serial Output ADC |
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