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参数资料
| 型号： | ISPPAC-POWR6AT6-01S32I |
| 厂商： | Lattice Semiconductor Corporation |
| 文件页数： | 8/35页 |
| 文件大小： | 0K |
| 描述： | IC PWR MANAGER ISP GP 32-QFNS |
| 产品培训模块： | Power and Board Management Solutions |
| 标准包装： | 490 |
| 系列： | ispPAC® |
| 应用： | 电源控制器/监控器 |
| 输入电压： | -0.3 V ~ 5.9 V |
| 电源电压： | 2.8 V ~ 3.96 V |
| 电流 - 电源： | 10mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-VFQFN 裸露焊盘 |
| 供应商设备封装： | 32-QFNS（5x5） |
| 包装： | 托盘 |
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Lattice Semiconductor
Timing for JTAG Operations
ispPAC-POWR6AT6 Data Sheet
Symbol
t ISPEN
t ISPDIS
t HVDIS
t HVDIS
t CEN
t CDIS
t SU1
t H
t CKH
t CKL
f MAX
t CO
t PWV
t PWP
Parameter
Program enable delay time
Program disable delay time
High voltage discharge time, program
High voltage discharge time, erase
Falling edge of TCK to TDO active
Falling edge of TCK to TDO disable
Setup time
Hold time
TCK clock pulse width, high
TCK clock pulse width, low
Maximum TCK clock frequency
Falling edge of TCK to valid output
Verify pulse width
Programming pulse width
Conditions
Min.
10
30
30
200
—
—
5
10
20
20
—
—
30
20
Typ.
—
—
—
—
—
—
—
—
—
—
—
—
—
—
Max.
—
—
—
—
10
10
—
—
—
—
25
10
—
—
Units
μs
μs
μs
μs
ns
ns
ns
ns
ns
ns
MHz
ns
μs
ms
Figure 3-2. Erase (User Erase or Erase All) Timing Diagram
VIH
TMS
VIL
t SU1
t H
t SU1
t H
t SU1
t H
t SU1
t H
t SU1
t H
t SU1
t H
VIH
t CKH
t GKL
t CKH
t CKH
t GKL
t CKH
t CKH
TCK
VIL
t SU2
Specified by the Data Sheet
State
Update-IR
Run-Test/Idle (Erase)
Select-DR Scan
Run-Test/Idle (Discharge)
Figure 3-3. Programming Timing Diagram
VIH
TMS
VIL
VIH
t SU1
t H
t CKH
t SU1
t CKL
t H
t PWP
t SU1
t H
t CKH
t SU1
t H
t CKH
t SU1
t CKL
t H
t CKH
TCK
VI L
State
Update-IR
Run-Test/Idle (Program)
Select-DR Scan
Update-IR
3-8
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