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参数资料
| 型号： | KITMMA9550LEVM |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 191/410页 |
| 文件大小： | 0K |
| 描述： | KIT EVALUATION FOR MMA955XL |
| 应用说明： | MMA9550L High-Resolution AppNote |
| 标准包装： | 1 |
| 传感器类型： | 加速计，3 轴 |
| 传感范围： | ±2g，4g，8g |
| 接口： | I²C |
| 灵敏度： | 0.061mg/LSB，0.122mg/LSB，0.244mg/LSB |
| 嵌入式： | 否 |
| 已供物品： | 2 个板，线缆，文档 |
| 已用 IC / 零件： | MMA955XL |
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System Integration Module
Figure 11-2 on page 191 illustrates how the six reset sources outlined in the previous section are processed
to generate three different reset domains. The “Pulse Shaper” blocks have the following characteristics:
? A logic zero on the input is transmitted immediately to the output.
? A logic one on the input is only transmitted to the output on a positive edge of the clock N clock
periods after the input de-assertion. ( N is specified as a number in the upper right corner of each
block.)
These functions ensure that internal resets assert asynchronously and de-assert synchronously. They also
guarantee that the internal resets are stable long enough to propagate properly throughout the system.
The RESETB pin is an open-drain, bidirectional function and must be connected to an external pullup
resistor. RESETB is pulled low for a minimum of 16 clock cycles in response to any internally generated
reset event. The external RESETB input is only sampled when the internal CPU reset has been deasserted
for two cycles or more.
Internal reset domains are the following:
extended_por_b This signal is a minimum of 4096 cycles long and is initiated by the internal,
Power-on-Reset circuitry. It feeds the specialized registers which are reset only on
power-up.
sim_chip_resetb This is the general chip reset used to place on-chip logic into its default state.
sim_cpu_resetb The CPU is the last block in the digital domain to be freed from reset. This occurs
32 cycles after de-assertion of sim_chip_resetb. The 32 cycles are required to
fetch the device security setting from on-chip flash memory before allowing the
CPU to boot.
Figure 11-3 shows an idealized start-up sequence in which the raw POR signal starts immediately at time
zero. The oscillator starts some time after desertion of the raw POR. The extended_por_b signal is
extended a minimum of 4,096 cycles after that.
NOTE
In order for the selected boot from flash to happen, the RESETB pin has to
be cleared before the end of the 4,096-cycle, extended period (about
500 μs). This bounds the time constant of any external filtering circuit that
may be added for EMC and noise immunity.
.
oscout
Raw POR
extended_por_b
sim_chip_resetb
4096 cycles
16 cycles
32 cycles
sim_cpu_resetb
Figure 11-3. Power-On-Reset sequence
MMA955xL Intelligent, Motion-Sensing Platform Hardware Reference Manual, Rev. 1.0
192
Freescale Semiconductor, Inc.
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