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参数资料
| 型号： | LT1956IFE-5#PBF |
| 厂商： | Linear Technology |
| 文件页数： | 24/28页 |
| 文件大小： | 0K |
| 描述： | IC REG BUCK 5V 1.5A 16TSSOP |
| 标准包装： | 95 |
| 类型： | 降压（降压） |
| 输出类型： | 固定 |
| 输出数： | 1 |
| 输出电压： | 5V |
| 输入电压： | 5.5 V ~ 60 V |
| PWM 型： | 电流模式 |
| 频率 - 开关： | 500kHz |
| 电流 - 输出： | 1.5A |
| 同步整流器： | 无 |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm）裸露焊盘 |
| 包装： | 管件 |
| 供应商设备封装： | 16-TSSOP-EP |
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LT1956/LT1956-5
APPLICATIO S I FOR ATIO
D2
MMSD914TI
C2
0.1 μ F
V IN
9V TO 12V
(TRANSIENTS
TO 36V)
V IN
BOOST
LT1956
SW
L1*
15 μ H
V OUT1 **
5V
SHDN
R1
C3
2.2 μ F
50V
CERAMIC
SYNC
GND
FB
V C
15.4k
R2
4.99k
+
C5
10 μ F
6.3V
CER
GND
R C
2.2k
C C
3300pF
C F
220pF
D1
B0540W
6.3V
**SEE FIGURE 14c FOR V OUT1 , V OUT2
IF LOAD CAN GO TO ZERO, AN OPTIONAL
*SUMIDA CDRH4D28-150
LOAD CURRENT RELATIONSHIP
?
PRELOAD OF 500 ? CAN BE
C4
10 μ F
CER
+
L2*
D3
C6
10 μ F
6.3V CER
+
V OUT2 ** ?
–5V
USED TO IMPROVE REGULATION
B0540W
1956 F14a
Figure 14a. Dual Polarity Output Converter
500
5.30
100
450
400
350
300
250
200
150
100
50
5.25
5.20
5.15
5.10
5.05
5.00
4.95
4.90
4.85
4.80
V OUT1 LOAD CURRENT
750mA
V OUT1 LOAD CURRENT
500mA
V OUT1 LOAD CURRENT
250mA
90
80
70
60
50
40
30
20
10
V OUT1 LOAD CURRENT
750mA
V OUT1 LOAD CURRENT
250mA
0
0
200
400
600
800
4.75
0
100 200 300 400
500
600
0
0
100
200
300
400
500
V OUT1 LOAD CURRENT (mA)
1956 F15b
Figure 14b. V OUT2 (–5V) Maximum
Allowable Load Current vs V OUT1
(5V) Load Current
V OUT2 LOAD CURRENT (mA)
1956 F14c
Figure 14c. V OUT2 (–5V) Output
Voltage vs Load Current
V OUT2 LOAD CURRENT (mA)
1956 F14d
Figure 14d. Dual Polarity Output
Converter Efficiency
couples energy to L2 and ensures equal voltages across
L2 and L1 during steady state. Instead of using a trans-
former for L1 and L2, uncoupled inductors were used
because they require less height than a single transformer,
can be placed separately in the circuit layout for optimized
space savings and reduce overall cost. This is true even
when the uncoupled inductors are sized (twice the value of
inductance of the transformer) in order to keep ripple
current comparable to the transformer solution. If a single
transformer becomes available to provide a better height/
cost solution, refer to the dual output SEPIC circuit de-
scription in Design Note 100 for correct transformer
connection.
During switch on-time, in steady state, the voltage across
both L1 and L2 is positive and equal; with energy (and
current) ramping up in each inductor. The current in L2 is
provided by the coupling capacitor C4. During switch off-
time, current ramps downward in each inductor. The
1956f
24
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PDF描述 |
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| LT1766IFE-5#PBF | IC REG BUCK 5V 1.5A 16TSSOP |
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