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参数资料
| 型号： | LTC3802EUH#TR |
| 厂商： | Linear Technology |
| 文件页数： | 10/28页 |
| 文件大小： | 0K |
| 描述： | IC REG CTRLR BUCK PWM VM 32-QFN |
| 标准包装： | 2,500 |
| 系列： | PolyPhase® |
| PWM 型： | 电压模式 |
| 输出数： | 2 |
| 频率 - 最大： | 850kHz |
| 占空比： | 92% |
| 电源电压： | 3 V ~ 30 V |
| 降压： | 是 |
| 升压： | 无 |
| 回扫： | 无 |
| 反相： | 无 |
| 倍增器： | 无 |
| 除法器： | 无 |
| Cuk： | 无 |
| 隔离： | 无 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 32-WFQFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
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LTC3802
PI FU CTIO S
(28-Pin SSOP/32-Pin QFN Package)
PHASEMD (Pin 17/Pin 15): Phase Selector Input. This pin
determines the phase relationships between controller 1,
controller 2 and the PLLIN signal. When PHASEMD is
floating, its value is around 2V, and the internal phase-
locked loop synchronizes the falling edge of TG1 to the
falling edge of the PLLIN signal. When PHASEMD is forced
high, PLLIN leads TG1 by 90 ° . TG1 and TG2 remain at 180 °
out of phase independent of the PHASEMD input. When
PHASEMD is forced low, an internal current source dis-
charges the RUN/SS slowly to provide power down track-
ing. Avoid coupling noise into this sensitive pin.
FB2 (Pin 18/Pin 16): Channel 2 Controller Error Amplifier
Input. See FB1.
COMP2 (Pin 19/Pin 17): Channel 2 Controller Error Am-
plifier Output. See COMP1.
V CC (Pin 20/Pin 18): Power Supply Input. All the internal
circuits except the switcher output drivers are powered
from this pin. V CC should be connected to a low noise 5V
supply and should be bypassed to SGND with at least a
10 μ F capacitor in close proximity to the LTC3802.
CMPIN2 (Pin 21/Pin 19): Channel 2 Controller Compara-
tors Input. See CMPIN1.
I MAX2 (Pin 22/Pin 20): Channel 2 Controller Current Limit
Set. See I MAX1 .
PLLLPF (Pin 23/Pin 21): Phase-Locked Loop Lowpass
Filter. The phase-locked loop’s lowpass filter is tied to this
pin. Alternatively, this pin can be driven with an AC or DC
voltage source to vary the frequency of the internal
oscillator.
PLLIN (Pin 24/Pin 22): Phase-Locked Loop Input/Exter-
nal Synchronization Input to the Phase Detector. The
falling edge of this signal is used for frequency synchro-
nization. When PLLIN floats or shorts to ground, the
controllers free run at 550kHz.
SW2 (Pin 25/Pin 25): Channel 2 Controller Switching
Node. See SW1.
TG2 (Pin 26/Pin 26): Channel 2 Controller Top Gate Drive.
See TG1.
BOOST2 (Pin 27/Pin 27): Channel 2 Controller Top Gate
Driver Supply. See BOOST1.
BG2 (Pin 28/Pin 28): Channel 2 Controller Bottom Gate
Drive. See BG1.
Exposed Pad (Pin 33, QFN Package Only): Exposed Pad
is PGND, must be soldered to PCB.
3802f
10
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