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参数资料
| 型号： | M30833FJGP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100 |
| 文件页数： | 57/96页 |
| 文件大小： | 1028K |
| 代理商： | M30833FJGP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页当前第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页
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G
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3
M
BCLK
CSi
18ns.max
ADi
18ns.max
RD
18ns.max
-5ns.min
th(BCLK-AD)
-3ns.min
BHE
ADi
/DBi
0ns.min
18ns.max
-3ns.min
BCLK
CSi
18ns.max
ADi
18ns.max
-3ns.min
tcyc
BHE
ADi
/DBi
Data output
WR,WRL,
WRH
Address
Data input
26ns.min
td(BCLK-RD)
th(WR-CS)(2)
Address
td(AD-ALE)(2)
Address
tsu(DB-BCLK)
tac3(RD-DB)(1)
tdz(RD-AD)
8ns.max
ALE
-2ns.min
td(BCLK-ALE)
18ns.max
td(AD-ALE)=(tcyc/2-20)ns.min
th(ALE-AD)=(tcyc/2-10)ns.min, th(RD-AD)=(tcyc/2-10)ns.min, th(RD-CS)=(tcyc/2-10)ns.min
tac3(RD-DB)=(tcyc/2 x m-35)ns.max (m=3 with 2 wait states and m=5 with 3 wait states)
tac3(AD-DB)=(tcyc/2 x n-35)ns.max (n=5 with 2 wait states and n=7 with 3 wait states)
ALE
18ns.max
-2ns.min
td(BCLK-ALE)
th(ALE-AD)(1)
td(AD-ALE)=(tcyc/2-20)ns.min
th(ALE-AD)=(tcyc/2-10)ns.min, th(WR-AD)=(tcyc/2-10)ns.min
th(WR-CS)=(tcyc/2-10)ns.min, th(WR-DB)=(tcyc/2-10)ns.min
td(DB-WR)=(tcyc/2 x m-25)ns.min
Vcc=5V
td(BCLK-CS)
td(AD-ALE)(1)
th(ALE-AD)(1)
th(BCLK-RD)
th(RD-AD)(1)
th(RD-DB)
td(BCLK-AD)
th(BCLK-CS)
th(RD-CS)(1)
td(BCLK-WR)
th(BCLK-WR)
td(BCLK-CS)
td(BCLK-AD)
th(BCLK-AD)
th(BCLK-CS)
th(WR-AD)(2)
td(DB-WR)(2)
th(WR-DB)(2)
th(BCLK-ALE)
tcyc
NOTES:
2. Varies with operation frequency:
Measurement Conditions:
VCC=4.2 to 5.5V
Input high and low voltage:
VIH=2.5V, VIL=0.8V
Output high and low voltage:
VOH=2.0V, VOL=0.8V
NOTES:
1. Varies with operation frequency:
Read Timing
Write Timing (written in 2 cycles with no wait state)
Memory Expansion Mode and Microprocessor Mode
(with a wait state, when accessing an external memory and using the multiplexed bus)
tac3(AD-DB)(1)
Figure 5.4 VCC=5V Timing Diagram (3)
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PDF描述 |
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