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参数资料
| 型号： | M30833FJGP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100 |
| 文件页数： | 62/96页 |
| 文件大小： | 1028K |
| 代理商： | M30833FJGP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页当前第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页
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th(BCLK–HOLD)
tsu(HOLD–BCLK)
td(BCLK–HLDA)
Hi–Z
Measurement Conditions:
VCC=4.2 to 5.5V
Input high and low voltage: VIH=4.0V, VIL=1.0V
Output high and low voltage: VOH=2.5V, VOL=2.5V
Memory Expansion Mode and Microprocessor Mode
BCLK
HOLD input
HLDA output
P0, P1, P2,
P3, P4,
P50 to P52
(Valid with a wait state or with no wait state)
(Valid only with a wait state)
RDY input
tsu(RDY–BCLK)
th(BCLK–RDY)
BCLK
RD
(Multiplexed bus)
WR, WRL, WRH
(Separate bus)
RD
(Separate bus)
Vcc=5V
Figure 5.9 VCC=5V Timing Diagram (8)
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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