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参数资料
| 型号： | M30833FJGP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100 |
| 文件页数： | 76/96页 |
| 文件大小： | 1028K |
| 代理商： | M30833FJGP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页当前第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页
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M
BCLK
DW
DB
MAi
Vcc=3.3V
RAS
CASL
CASH
Hi-Z
tac4(CAS-DB)(2)
18ns.max(1)
th(BCLK-CAD)
0ns.min
tcyc
td(BCLK-RAD)
tac4(RAS-DB)(2)
Row address
Column address
th(BCLK-RAD)
0ns.min
18ns.max(1)
td(BCLK-CAD)
18ns.max(1)
td(BCLK-RAS)
18ns.max(1)
td(BCLK-CAS)
th(RAS-RAD)(1)
tRP(2)
tac4(CAD-DB)(2)
th(BCLK-RAS)
0ns.min
th(BCLK-CAS)
0ns.min
tsu(DB-BCLK)
30ns.min(1)
th(CAS-DB)
Measurement Conditions:
VCC=3.0 to 3.6V
Input high and low voltage: VIH=1.5V, VIL=0.5V
Output high and low voltage: VOH=1.5V, VOL=1.5V
Read Timing
Memory Expansion Mode and Microprocessor Mode
(With 2 wait states, when accessing the DRAM area)
NOTES:
1. Values guaranteed only when the microcomputer is used independently. A maximum of 35ns is
guaranteed for the followings:
td(BCLK-RAS) + tsu(DB-BCLK)
td(BCLK-CAS) + tsu(DB-BCLK)
td(BCLK-CAD) + tsu(DB-BCLK)
2. It varies with the operation frequency.
tac4(RAS-DB)=(tcyc/2 x m-35)ns.max (m=3 with 1 wait state and m=5 with 2 wait states)
tac4(CAS-DB)=(tcyc/2 x n-35)ns.max (n=1 with 1 wait state and n=3 with 2 wait states)
tac4(CAD-DB)=(tcyc x l-35)ns.max (l=1 with 1 wait state and l=2 with 2 wait states)
th(RAS-RAD)=(tcyc/2-13)ns.min
tRP=(tcyc/2 x 3-20)ns.min
Figure 5.13 VCC=3.3V Timing Diagram (4)
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