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参数资料
| 型号： | M37542F8VGP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP32 |
| 封装： | 7 X 7 MM, 0.80 MM PITCH, PLASTIC, LQFP-32 |
| 文件页数： | 54/139页 |
| 文件大小： | 1448K |
| 代理商： | M37542F8VGP |
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7542 Group
Rev.3.02
Oct 31, 2006
Page 21 of 134
REJ03B0006-0302
Fig. 20 Block diagram of ports (1)
(1) Port P00
Direction
register
Data bus
Port latch
Pull-up control
To key input interrupt
generating circuit
Capture 0 input
P00 key-on wakeup
selection bit
Drive capacity
control
Capture 0 input control
(2) Ports P01, P02
Compare output
Direction
register
Data bus
Port latch
Pull-up control
To key input interrupt
generating circuit
Compare output control
Drive capacity
control
(3) Port P03
Timer output
Direction
register
Data bus
Port latch
Pull-up control
To key input interrupt
generating circuit
P03/TXOUT output valid
Drive capacity
control
(4) Port P04
Serial I/O2 input
Direction
register
Data bus
Port latch
Pull-up control
To key input interrupt
generating circuit
Serial I/O2 enable bit
Drive capacity
control
P04 key-on wakeup
selection bit
Receive enable bit
(5) Port P05
Serial I/O2 output
Direction
register
Data bus
Port latch
Pull-up control
To key input interrupt
generating circuit
Serial I/O2 enable bit
Drive capacity
control
Transmit enable bit
(6) Port P06
Serial I/O2 clock output
Direction
register
Data bus
Port latch
Pull-up control
To key input interrupt
generating circuit
Serial I/O2 mode selection bit
Drive capacity
control
Serial I/O2 enable bit
Serial I/O2 synchronous
clock selection bit
Serial I/O2 clock input
P06 key-on wakeup
selection bit
Serial I/O2 enable bit
(7) Port P07
Serial I/O2 ready output
Direction
register
Data bus
Port latch
Pull-up control
To key input interrupt
generating circuit
Serial I/O2 mode selection bit
Serial I/O2 enable bit
SRDY2 output enable bit
Drive capacity
control
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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