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参数资料
| 型号： | M38503E4SP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 4 MHz, MICROCONTROLLER, PDIP42 |
| 封装： | 0.600 INCH, 1.78 MM PITCH, PLASTIC, SDIP-42 |
| 文件页数： | 45/286页 |
| 文件大小： | 3016K |
| 代理商： | M38503E4SP |
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2-44
3850 Group (Spec. H) User’s Manual
APPLICATION
2.4 Serial I/O
Fig. 2.4.8 Structure of UART control register
UART control register
b7 b6 b5 b4 b3 b2 b1 b0
UART control register
(UARTCON: address 1B16)
b
0
0: 8 bits
1: 7 bits
Character length
selection bit (CHAS)
Parity enable bit
(PARE)
Stop bit length
selection bit (STPS)
P25/TxD P-channel
output disable bit
(POFF)
Parity selection bit
(PARS)
Functions
Name
At reset R W
1
0
2
3
4
5
6
1
7
1
Nothing is arranged for these bits. These are
write disabled bits. When these bits are read
out, the contents are “1”.
0
1
0: Parity checking disabled
1: Parity checking enabled
0: Even parity
1: Odd parity
0: 1 stop bit
1: 2 stop bits
In output mode
0: CMOS output
1: N-channel open-drain
output
Fig. 2.4.7 Structure of Serial I/O1 control register
Serial I/O1 control register
b7 b6 b5 b4 b3 b2 b1 b0
Serial I/O1 control register
(SIOCON: address 1A16)
b
0
Name
0
Functions
At reset R W
0
1
2
0
3 Transmit interrupt
source selection
bit (TIC)
4
0
Transmit enable bit
(TE)
0: Transmit disabled
1: Transmit enabled
0: I/O port (P27)
1: SRDY1 output pin
0: Receive disabled
1: Receive enabled
0: UART
1: Clock synchronous
serial I/O
5
0
Receive enable bit
(RE)
7
6
0
Serial I/O1 mode
selection bit (SIOM)
Serial I/O1 enable
bit (SIOE)
0: Transmit buffer empty
1: Transmit shift operation
completion
0: f(XIN)
1: f(XIN)/4
When clock synchronous
serial I/O is selected,
0: BRG output divided by 4
1: External clock input
When UART is selected,
0: BRG output divided by 16
1: External clock input
divided by16
0: Serial I/O1 disabled
(P24 to P27: normal I/O pins)
1: Serial I/O1 enabled
(P24 to P27: Serial I/O pins)
Serial I/O1
synchronous clock
selection bit (SCS)
BRG count source
selection bit (CSS)
SRDY1 output
enable bit (SRDY)
0
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PDF描述 |
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