M38749EFFS PDF资料下载(337/358 页)8-BIT, UVPROM, 6.4 MHz, MICROCONTROLLER, CQCC80

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参数资料

型号：	M38749EFFS
元件分类：	微控制器/微处理器
英文描述：	8-BIT, UVPROM, 6.4 MHz, MICROCONTROLLER, CQCC80
封装：	CERAMIC, LCC-80
文件页数：	337/358页
文件大小：	4216K
代理商：	M38749EFFS

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3874 Group User’s Manual

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List of figures

CHAPTER 1. HARDWARE

Fig. 1 M38747MCT-XXXGP pin configuration ............................................................................ 1-3

Fig. 2 M38749EFFS pin configuration ......................................................................................... 1-4

Fig. 3 Functional block diagram ................................................................................................... 1-5

Fig. 4 Part numbering .................................................................................................................... 1-8

Fig. 5 Main clock input oscillation frequency in double-speed mode ..................................... 1-9

Fig. 6 Memory expansion plan (Extended operating temperature version) ......................... 1-10

Fig. 7 Memory expansion plan (Automotive correspondence version) ................................. 1-11

Fig. 8 740 Family CPU register structure ................................................................................. 1-12

Fig. 9 Register push and pop at interrupt generation and subroutine call ........................ 1-13

Fig. 10 Structure of CPU mode register ................................................................................... 1-15

Fig. 11 Memory map diagram .................................................................................................... 1-16

Fig. 12 Memory map of special function register (SFR) ........................................................ 1-17

Fig. 13 Structure of PULL UP register ..................................................................................... 1-20

Fig. 14 Port block diagram (1) ................................................................................................... 1-21

Fig. 15 Port block diagram (2) ................................................................................................... 1-22

Fig. 16 Port block diagram (3) ................................................................................................... 1-23

Fig. 17 Port block diagram (4) ................................................................................................... 1-24

Fig. 18 Port block diagram (5) ................................................................................................... 1-25

Fig. 19 Port block diagram (6) ................................................................................................... 1-26

Fig. 20 Interrupt control diagram ............................................................................................... 1-29

Fig. 21 Timing from occurrence to acceptance of interrupt ................................................... 1-31

Fig. 22 Structure of interrupt-related registers ......................................................................... 1-32

Fig. 23 Connection example when using key input interrupt and port P2 block diagram 1-33

Fig. 24 Timer block diagram ...................................................................................................... 1-34

Fig. 25 Structure of timer X mode register .............................................................................. 1-35

Fig. 26 Structure of timer Y mode register .............................................................................. 1-36

Fig. 27 Structure of timer 123 mode register .......................................................................... 1-37

Fig. 28 Block diagram of clock synchronous serial I/O .......................................................... 1-38

Fig. 29 Operation of clock synchronous serial I/O1 function ................................................ 1-38

Fig. 30 Block diagram of UART serial I/O1 ............................................................................. 1-39

Fig. 31 Operation of UART serial I/O function ........................................................................ 1-39

Fig. 32 Structure of serial I/O1 control register ....................................................................... 1-41

Fig. 33 Structure of serial I/O2 control register ....................................................................... 1-42

Fig. 34 Block diagram of serial I/O2 ......................................................................................... 1-42

Fig. 35 Serial I/O2 timing (LSB first) ........................................................................................ 1-43

Fig. 36 Block diagram of serial I/O3 ......................................................................................... 1-44

Fig. 37 Structure of serial I/O3 control register 1 and 2 ....................................................... 1-45

Fig. 38 Structure of serial I/O3 control register 3 ................................................................... 1-46

Fig. 39 Structure of serial I/O3 automatic transfer data pointer ........................................... 1-47

Fig. 40 Automatic transfer serial I/O operation ....................................................................... 1-48

Fig. 41 Arbitrary bit serial I/O operation ................................................................................... 1-49

Fig. 42 SSTB3 output operation .................................................................................................... 1-50

Fig. 43 SBUSY3 input operation (internal synchronous clock) ................................................... 1-50

Fig. 44 SBUSY3 input operation (external synchronous clock) .................................................. 1-50

Fig. 45 SBUSY3 output operation (internal synchronous clock, 8-bit serial I/O) ..................... 1-51

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