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参数资料
| 型号： | M68HC16Y1CFC |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, MICROCONTROLLER, PQFP16 |
| 封装： | QFP-160 |
| 文件页数： | 110/138页 |
| 文件大小： | 784K |
| 代理商： | M68HC16Y1CFC |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页当前第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页
MC68HC16Y1
MOTOROLA
MC68HC16Y1TS/D
73
HOT4 — Hang on T4
0 = Exit wait on T4 state caused by assertion of HOT4
1 = Enter wait on T4 state
DSCR[14:11] — Not Implemented
BLC — Branch Latch Control
1 = Do not latch conditions into branch condition register before exiting the halted state or during
the time-slot transition period.
0 = Latch conditions into branch condition register prior to exiting halted state.
CLKS — Stop Clocks (to TCRs)
0 = Do not stop TCRs.
1 = Stop TCRs during the halted state.
FRZ[1:0] — IMB FREEZE Response
The FRZ bits specify the TPU microengine response to the FREEZE signal.
CCL — Channel Conditions Latch
CCL controls the latching of channel conditions (MRL and TDL) when CHAN is written.
0 = Only the pin state condition of the new channel is latched as a result of the write CHAN register
microinstruction.
1 = Pin state, MRL, and TDL conditions of the new channel are latched as a result of a write CHAN
register microinstruction.
BP, BC, BH, BL, BM, and BT — Breakpoint Enable Bits
DSCR[5:0] are TPU breakpoint enables. Setting a bit enables a breakpoint condition.
BP —Break if
PC equals PC breakpoint register.
BC —Break if CHAN register equals channel breakpoint register at beginning of state or when
CHAN is changed through microcode.
BH —Break if host service latch is asserted at beginning of state.
BL —Break if link service latch is asserted at beginning of state.
BM —Break if MRL is asserted at beginning of state.
BT —Break if TDL is asserted at beginning of state.
DSSR[15:8, 2:0] — Not Implemented
DSCR — Development Support Control Register
$YFFE04
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
HOT4
0
BLC
CLKS
FRZ
CCL
BP
BC
BH
BL
BM
BT
RESET:
0
FRZ[1:0]
TPU Response
00
Ignore Freeze
01
Reserved
10
Freeze at End of Current Microcycle
11
Freeze at Next Time-Slot Boundary
DSSR — Development Support Status Register
$YFFE06
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
BKPT
PCBK
CHBK
SRBK
TPUF
0
RESET:
0
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PDF描述 |
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