参数资料
| 型号： | MA330029 |
| 厂商： | Microchip Technology |
| 文件页数： | 57/322页 |
| 文件大小： | 0K |
| 描述： | MODULE PLUG-IN DSPIC33FJ16GP102 |
| 标准包装： | 1 |
| 系列： | * |
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dsPIC33FJ16GP101/102 AND dsPIC33FJ16MC101/102
TABLE 4-30:
FUNDAMENTAL ADDRESSING MODES SUPPORTED
Addressing Mode
File Register Direct
Register Direct
Register Indirect
Register Indirect Post-Modified
Register Indirect Pre-Modified
Description
The address of the file register is specified explicitly.
The contents of a register are accessed directly.
The contents of Wn forms the Effective Address (EA).
The contents of Wn forms the EA. Wn is post-modified (incremented
or decremented) by a constant value.
Wn is pre-modified (incremented or decremented) by a signed constant value
to form the EA.
Register Indirect with Register Offset The sum of Wn and Wb forms the EA.
(Register Indexed)
Register Indirect with Literal Offset
The sum of Wn and a literal forms the EA.
4.3.3
MOVE AND ACCUMULATOR
4.3.4
MAC INSTRUCTIONS
INSTRUCTIONS
Move instructions and the DSP accumulator class of
instructions provide a greater degree of addressing
flexibility than other instructions. In addition to the
addressing modes supported by most MCU
instructions, move and accumulator instructions also
support Register Indirect with Register Offset
Addressing mode, also referred to as Register Indexed
mode.
The dual source operand DSP instructions ( CLR , ED ,
EDAC , MAC , MPY , MPY.N , MOVSAC , and MSC ), also
referred to as MAC instructions, use a simplified set of
addressing modes to allow the user application to
effectively manipulate the data pointers through register
indirect tables.
The two-source operand prefetch registers must be
members of the set {W8, W9, W10, W11}. For data
reads, W8 and W9 are always directed to the X RAGU,
Note:
For the MOV instructions, the addressing
mode specified in the instruction can differ
for the source and destination EA.
However, the 4-bit Wb (Register Offset)
field is shared by both source and
and W10 and W11 are always directed to the Y AGU.
The effective addresses generated (before and after
modification) must, therefore, be valid addresses within
X data space for W8 and W9 and Y data space for W10
and W11.
destination (but typically only used by
one).
Note:
Register Indirect with Register Offset
Addressing mode is available only for W9
In summary, the following addressing modes are
supported by move and accumulator instructions:
(in X space) and W11 (in Y space).
In summary, the following addressing modes are
?
Register Direct
supported by the MAC class of instructions:
?
?
?
?
?
Register Indirect
Register Indirect Post-modified
Register Indirect Pre-modified
Register Indirect with Register Offset (Indexed)
Register Indirect with Literal Offset
?
?
?
?
?
Register Indirect
Register Indirect Post-Modified by 2
Register Indirect Post-Modified by 4
Register Indirect Post-Modified by 6
Register Indirect with Register Offset (Indexed)
?
?
8-bit Literal
16-bit Literal
4.3.5
OTHER INSTRUCTIONS
Note:
Not all instructions support all the
addressing modes given above. Individual
instructions may support different subsets
of these addressing modes.
In addition to the addressing modes outlined previously,
some instructions use literal constants of various sizes.
For example, BRA (branch) instructions use 16-bit signed
literals to specify the branch destination directly, whereas
the DISI instruction uses a 14-bit unsigned literal field. In
some instructions, such as ADD Acc , the source of an
operand or result is implied by the opcode itself. Certain
operations, such as NOP , do not have any operands.
? 2011 Microchip Technology Inc.
Preliminary
DS70652C-page 57
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