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参数资料
| 型号： | MB86R01PB-GSE1 |
| 厂商： | Fujitsu Semiconductor America Inc |
| 文件页数： | 85/89页 |
| 文件大小： | 0K |
| 描述： | IC SOC GRAPHIC CONTRLR 484BGA |
| 特色产品： | Graphics Display Controllers (GDC) |
| 标准包装： | 40 |
| 系列： | 玉 |
| 应用： | 图形控制器 |
| 核心处理器： | ARM9 |
| 程序存储器类型： | 外部程序存储器 |
| 控制器系列： | 玉 |
| RAM 容量： | 64K x 8 |
| 接口： | ADC，ATA，CAN，EBI/EMI，I²C，I²S，媒体 LB，PWM，SD 卡，UART/USART，USB |
| 输入/输出数： | 24 |
| 电源电压： | 1.1 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 484-BGA |
| 包装： | 托盘 |
| 供应商设备封装： | 484-BGA（23x23） |
| 其它名称： | 865-1110 |
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80
FUJITSU MICROELECTRONICS
PROPRIETARY AND CONFIDENTIAL
MB86R01 DATA SHEET
8.5.15.
SD Signal Timing
8.5.15.1.
Clock
Table 8-52
AC Timing of Clock Signal
Value
Signal Name
Symbol
Description
Min.
Typ.
Max.
Unit
SD_CLK
t_CLK
SD_CLK cycle
–
20.83 (*1) MHz
*1: 20.83MHz for SD memory card and 20MHz for multimedia card (MMC)
8.5.15.2.
Input/Output Signal
Table 8-53
AC Timing of Data Signal
Value
Signal Name
Symbol
Description
Min.
Typ.
Max.
Unit
tD_DAT
Output data delay (standard of SD_CLK
falling edge)
-6.0
–
3.0
ns
tS_DAT
Input data setup (standard of SD_CLK rising
edge)
13.0
–
ns
SD_DAT[3:0]
tH_DAT
Input data hold (standard of SD_CLK rising
edge)
19.0
–
ns
SD_CLK
SD_DAT[3:0]
tD_DAT
t_SDCLK
Figure 8-36
Output Timing to Media
SD_DAT[3:0]
SD_CLK
VALID
DATA
tS_DAT
tH_DAT
VALID
DATA
tS_DAT
tH_DAT
Figure 8-37
Input Timing from Media
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