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参数资料
| 型号： | MB95D108AWPFV |
| 厂商： | FUJITSU LTD |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 10 MHz, MICROCONTROLLER, PQFP64 |
| 封装： | 10 X 10 MM, 1.70 MM HEIGHT, 0.50 MM PITCH, PLASTIC, LQFP-64 |
| 文件页数： | 43/67页 |
| 文件大小： | 824K |
| 代理商： | MB95D108AWPFV |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页当前第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页
MB95100A Series
48
(6) UART/SIO, Serial I/O Timing
(VCC
= 3.3 V, AVSS = VSS = 0.0 V, TA = 40 °C to + 85 °C)
* : Refer to “ (2) Source Clock/Machine Clock” for tMCLK.
Parameter
Symbol
Pin name
Conditions
Value
Unit Remarks
Min
Max
Serial clock cycle time
tSCYC
UCK0
Internal clock
operation output pin :
CL
= 80 pF + 1TTL.
4 tMCLK*
ns
UCK
↓ → UO time
tSLOV
UCK0, UO0
190
+ 190
ns
Valid UI
→ UCK ↑
tIVSH
UCK0, UI0
2 tMCLK*
ns
UCK
↑ → valid UI hold time
tSHIX
UCK0, UI0
2 tMCLK*
ns
Serial clock “H” pulse width
tSHSL
UCK0
External clock
operation output pin :
CL
= 80 pF + 1TTL.
4 tMCLK*
ns
Serial clock “L” pulse width
tSLSH
UCK0
4 tMCLK*
ns
UCK
↓ → UO time
tSLOV
UCK0, UO0
0
190
ns
Valid UI
→ UCK ↑
tIVSH
UCK0, UI0
2 tMCLK*
ns
UCK
↑ → valid UI hold time
tSHIX
UCK0, UI0
2 tMCLK*
ns
tSCYC
tIVSH
0.8 VCC
0.2 VCC
0.8 VCC
0.2 VCC
tSHIX
tSLOV
0.8 V
2.4 V
0.8 V
2.4 V
UCK0
UO0
UI0
0.8 V
tSLSH
tIVSH
tSHIX
tSLOV
0.2 VCC 0.2 VCC
0.8 VCC 0.8 VCC
tSHSL
2.4 V
UCK0
UO0
UI0
0.8 V
0.8 VCC
0.2 VCC
0.8 VCC
Internal shift clock mode
External shift clock mode
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PDF描述 |
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