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参数资料
| 型号： | MB9BF504NPMC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 80 MHz, RISC MICROCONTROLLER, PQFP100 |
| 封装： | 14 X 14 MM, 1.70 MM HEIGHT, 0.50 MM PITCH, PLASTIC, LQFP-100 |
| 文件页数： | 18/120页 |
| 文件大小： | 1277K |
| 代理商： | MB9BF504NPMC |
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114
8266D-MCU Wireless-06/12
ATmega128RFA1
Table 9-44 PDT_THRES Register Bits
Register Bits
Value
Description
0x7
Reset value, to be used if Antenna Diversity
algorithm is disabled
PDT_THRES3:0
0x3
Recommended correlator threshold for
Antenna Diversity operation
9.12.15 SFD_VALUE – Start of Frame Delimiter Value Register
Bit
7
6
5
4
3
2
1
0
NA ($14B)
SFD_VALUE7:0
SFD_VALUE
Read/Write
RW
Initial Value
1
0
1
0
1
This register contains the one octet start-of-frame delimiter (SFD) to synchronize to a
received frame. The lower 4 bits must not be all zero to avoid decoding conflicts.
Bit 7:0 – SFD_VALUE7:0 - Start of Frame Delimiter Value
For compliant IEEE 802.15.4 networks set SFD_VALUE = 0xA7. This is the default
value of the register. To establish non IEEE 802.15.4 compliant networks the SFD value
can be changed to any other value. If enabled a RX_START interrupt is issued only if
the received SFD matches the register content of SFD_VALUE and a valid PHR is
received.
Table 9-45 SFD_VALUE Register Bits
Register Bits
Value
Description
SFD_VALUE7:0
0xA7
IEEE 802.15.4 compliant value of the SFD
9.12.16 TRX_CTRL_2 – Transceiver Control Register 2
Bit
7
6
5
4
NA ($14C)
RX_SAFE_MODE
Res4
Res3
Res2
TRX_CTRL_2
Read/Write
RW
R
Initial Value
0
Bit
3
2
1
0
NA ($14C)
Res1
Res0
OQPSK_DATA_RATE1 OQPSK_DATA_RATE0
TRX_CTRL_2
Read/Write
R
RW
Initial Value
0
This register controls the data rate setting of the radio transceiver.
Bit 7 – RX_SAFE_MODE - RX Safe Mode
If this bit is set, the next received frame will be protected and not overwritten by
following frames. Set this bit to 0 to release the buffer (and set it again for further
protection).
Bit 6:2 – Res4:0 - Reserved
Bit 1:0 – OQPSK_DATA_RATE1:0 - Data Rate Selection
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PDF描述 |
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