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参数资料
| 型号： | MC13892VKR2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 78/158页 |
| 文件大小： | 0K |
| 描述： | IC PMU I.MX51/37/35/27 139MAPBGA |
| 标准包装： | 2,000 |
| 应用： | 电池管理，显示器（LED 驱动器），手持/移动设备，电源 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 139-TFBGA |
| 供应商设备封装： | 139-PBGA（7x7） |
| 包装： | 带卷 (TR) |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页当前第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页
FUNCTIONAL DEVICE OPERATION
SUPPLIES
100 %
90 %
80 %
70 %
S W1 P WM Pu lse S kip pi ng mo de E ffi ciency Vo ut = 0, 725 V
100 %
90 %
80 %
70 %
S W1 PWM P ulse Ski ppi ng mo de E ffi ciency Vo ut = 0, 725 V
60 %
50 %
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Vin = 3 ,00 0 V
Vin = 3 ,60 0 V
Vin = 4 ,65 0 V
60 %
50 %
40 %
Vin = 3,0 00 V
Vin = 3,6 00 V
Vin = 4,6 50 V
30 %
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50 1 00 150 200 25 0 300 35 0 4 00 450 50 0 55 0 6 00 650 70 0 7 50 800 85 0 90 0 9 50 10 0 1 05
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0
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Ilo a d (m A)
S W2 P WM Pu lse S kip pi ng mo de E ffi ciency Vo ut = 1. 250 V
100 %
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Il oa d (m A)
S W2 P WM Pu lse S kip pin g m od e E ffici ency V ou t = 1.250 V
60 %
50 %
40 %
30 %
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10 %
0%
Vin = 3 ,00 0 V
Vin = 3 ,60 0 V
Vin = 4 ,65 0 V
60 %
50 %
40 %
30 %
20 %
10 %
0%
Vin = 3, 000 V
Vin = 3, 600 V
Vin = 4, 650 V
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1 00 1 50 20 0 25 0 300
350 4 00 4 50 50 0 55 0 600
650 7 00 7 50 80 0 85 0 900
100 %
90 %
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Ilo a d (m A)
S W4 P WM Pu lse S kip pi ng mo de E ffi ciency Vo ut = 1. 800 V
100 %
90 %
80 %
70 %
Ilo a d (m A)
S W4 PWM P ulse Ski ppi ng mo de E ffi ciency Vo ut = 1. 800 V
60 %
50 %
40 %
30 %
20 %
10 %
0%
Vin = 3 ,00 0 V
Vin = 3 ,60 0 V
Vin = 4 ,65 0 V
60 %
50 %
40 %
30 %
20 %
10 %
0%
Vin = 3,0 00 V
Vin = 3,6 00 V
Vin = 4,6 50 V
0
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30
40
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1 00 1 50 20 0 2 50 30 0 35 0 400
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750 8 00
850 9 00
Ilo a d (m A)
Il oa d (m A)
Figure 19. Buck Regulator PWM (Pulse Skipping) Efficiency
DYNAMIC VOLTAGE SCALING
To reduce overall power consumption, processor core voltages can be varied depending on the mode or activity level of the
processor. SW1 and SW2 allow for three different set points with controlled transitions to avoid sudden output voltage changes,
which could cause logic disruptions on their loads. Preset operating points for SW1 and SW2 can be set up for:
? Normal operation: output value selected by SPI bits SWx[4:0]. Voltage transitions initiated by SPI writes to SWx[4:0] are
governed by the same DVS stepping rate that is programmed for DVSx pin initiated transitions.
? DVS: output can be higher or lower than normal operation for tailoring to application requirements. Configured by SPI bits
SWxDVS[4:0] and controlled by a DVSx pin transition.
? Standby (Deep Sleep): can be higher or lower than normal operation, but is typically selected to be the lowest state retention
voltage of a given process. Set by SPI bits SWxSTBY[4:0] and controlled by a Standby event (STANDBY logically anded with
STANDBYSEC). Voltage transitions initiated by Standby are governed by the same DVS stepping that is programmed for
DVSx pin initiated transitions.
The following tables summarize the set point control and DVS time stepping applied to SW1 and SW2.
MC13892
Analog Integrated Circuit Device Data
78
Freescale Semiconductor
相关PDF资料 |
PDF描述 |
|---|---|
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