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参数资料
| 型号： | MC15XS3400CPNAR2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 29/52页 |
| 文件大小： | 0K |
| 描述： | IC SWITCH HIGH SIDE QUAD 24-QFN |
| 标准包装： | 1,200 |
| 类型： | 高端开关 |
| 输出数： | 4 |
| Rds（开）： | 15 毫欧 |
| 内部开关： | 是 |
| 电流限制： | 5A |
| 输入电压： | 6 V ~ 20 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-PowerQFN |
| 供应商设备封装： | 24-PQFN（12x12） |
| 包装： | 带卷 (TR) |
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FUNCTIONAL DEVICE OPERATION
OPERATIONAL MODES
FAIL-SAFE MODE
The 15XS3400 is in Fail-safe mode when:
Table 9. SPI Watchdog Activation
? V PWR is within the normal voltage range,
? wake-up = 1,
? fail = 1,
? fault = 0.
Typical RFSI ( Ω )
0 (shorted to ground)
(open)
Watchdog
Disabled
Enable
Watchdog
If the FSI input is not grounded, the watchdog timeout
detection is active when either the WAKE or IN_ON[0:3] or
RST input pin transitions from logic [0] to logic [1]. The WAKE
input is capable of being pulled up to VPWR with a series of
limiting resistance limiting the internal clamp current
according to the specification.
The watchdog timeout is a multiple of an internal oscillator .
As long as the WD bit (D15) of an incoming SPI message is
toggled within the minimum watchdog timeout period
(WDTO), the device will operate normally.
Fail-safe Conditions
If an internal watchdog timeout occurs before the WD bit
for FSI open ( Table 9 ) or in case of V DD failure condition
(V DD < V DD(FAIL) )) for VDD_FAIL_en bit is set to logic [1], the
device will revert to a Fail-safe mode until the WD bit is written
to logic [1] (see fail-safe to normal mode transition paragraph)
and V DD is within the normal voltage range.
During the Fail-safe mode, the outputs will depend on the
corresponding input. The SPI register content is reset to their
default value (except POR bit) and fault protections are fully
operational.
The Fail-safe mode can be detected by monitoring the NM
bit is set to [0].
NORMAL & FAIL-SAFE MODE TRANSITIONS
Transition Fail-Safe to Normal mode
To leave the Fail-safe mode, V DD must be in nominal
voltage and the microcontroller has to send a SPI command
with WDIN bit set to logic [1] ; the other bits are not
considered. The previous latched faults are reset by the
transition into Normal mode (autoretry included).
Moreover, the device can be brought out of the Fail-safe
mode due to watchdog timeout issue by forcing the FSI pin to
logic [0].
Transition Normal to Fail-safe Mode
To leave the Normal mode, a fail-safe condition must
occurred (fail=1). The previous latched faults are reset by the
transition into Fail-safe mode (autoretry included).
15XS3400
Analog Integrated Circuit Device Data
Freescale Semiconductor
29
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PDF描述 |
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参数描述 |
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