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参数资料
| 型号： | MC33298 |
| 厂商： | 飞思卡尔半导体(中国)有限公司 |
| 英文描述： | Eight Output Switch with Serial Peripheral Interface I/O(带SPI接口的八输出开关) |
| 中文描述： | 8个串行外围接口的I / O（带的SPI接口的八输出开关输出开关） |
| 文件页数： | 8/28页 |
| 文件大小： | 642K |
| 代理商： | MC33298 |
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33298
8
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Figure 2. Input Timing Switch Characteristics
STATIC ELECTRICAL CHARACTERISTICS (continued)
Characteristics noted under conditions 4.5 V
≤
V
DD
≤
5.5 V, 9.0 V
≤
V
PWR
≤
16 V, -40
°
C
≤
T
A
≤
125
°
C, unless otherwise noted. Typical
values noted reflect the approximate value with V
PWR
= 13 V, T
A
= 25
°
C.
Characteristic
Symbol
Min
Typ
Max
Unit
Digital Interface
Input Logic High Voltage (Note 22)
V
IH
0.7
—
1.0
V
DD
Input Logic Low Voltage (Note 23)
V
IL
0
—
0.2
V
DD
Input Logic Voltage Hysteresis (Note 24)
V
I(HYS)
50
100
500
mV
Input Logic Current (Note 25)
I
IN
-10
0
10
μA
RST Pull-Up Current (RST = 0.7 V
DD
)
I
RST
10
22
50
μA
SFPD Pull-Down Current (SFPD = 0.2 V
DD
)
I
SFPD
10
22
50
μ
A
SO High State Output Voltage (I
OH
= 1.0 mA)
V
SOH
V
DD
-1.0 V
V
DD
-0.6 V
—
V
SO Low State Output Voltage (I
OL
= -1.6 mA)
V
SOL
—
0.2
0.4
V
SO Tri-State Leakage Current (CS = 0.7 VDD, 0 V < V
SO
< V
DD
)
I
SOT
-10
0
10
μA
Input Capacitance (0 V < V
DD
< 5.5 V) (Note 26)
C
IN
—
—
12
pF
SO Tri-State Capacitance (0 V < V
DD
< 5.5 V) (Note 27)
C
SOT
—
—
20
pF
Notes:
22.
23.
24.
25.
26.
Upper and lower logic threshold voltage levels apply to SI, CS, SCLK, RST, and SFPD inputs.
Lower logic threshold voltage range applies to SI, CS, SCLK, Reset, and SFPD input signals.
Only the SFPD and Reset inputs have hysteresis. This parameter is guaranteed by design, but it is not production tested.
Input current of SCLK, SI and CS logic control inputs.
Input capacitance of SI, CS, SCLK, RST, and SFPD for 0 V < VDD < 5.5 V. This parameter is guaranteed by design, but it is not production
tested.
Tri-state capacitance of SO for 0 V < VDD < 5.5 V. This parameter is guaranteed by design, but it is not production tested.
27.
V
IH
V
IL
Don't Care
0.2 V
DD
0.7 V
DD
t
lag
t
r
t
f
SI
t
w(SCLKL)
t
SI(hold)
t
SI(su)
Valid
t
w(SCLKH)
0.7 V
DD
0.2 V
DD
t
lead
SCLK
0.2 V
DD
0.2 V
DD
t
w(RST)
RST
CS
Don't Care
Don't Care
Valid
V
IH
V
IL
V
IH
V
IL
V
IH
V
IL
F
Freescale Semiconductor, Inc.
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n
.
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