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参数资料
| 型号： | MC33389CDW |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 35/49页 |
| 文件大小： | 0K |
| 描述： | IC SYSTEM BASE W/CAN 28-SOIC |
| 标准包装： | 26 |
| 控制器类型： | 系统基础芯片 |
| 接口： | CAN |
| 电源电压： | 5.5 V ~ 18 V |
| 电流 - 电源： | 45mA |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 28-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 28-SOIC W |
| 包装： | 管件 |
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Analog Integrated Circuit Device Data
40
Freescale Semiconductor
33389
FUNCTIONAL DEVICE OPERATION
LOGIC COMMANDS AND REGISTERS
The next two registers (IMR1 and IMR2) mask the interrupt function.
The next two registers (ISR1 and ISR2) read the interrupt source. All bits in registers ISR1 and ISR2 are copies of the
appropriate bits in different SPI registers. For a faster read-out, these bits are merged in ISR1 and ISR2. A reset cannot be
completed for registers ISR1 and ISR2.
Table 41. VBSR1 VBSR0
VBSR1
VBSR0
Description
0
No Failure on VBAT
x
1
Under Voltage (BATFail)
1
x
Over Voltage (BATHigh)
V2SR: 1 = V2 ON, 0 = V2 OFF
V3SR: 1 = V3 over temperature, 0 = V3 no over temperature
VBSR1 is real time information. It cannot be reset. Bits V3SR, V2SR, and VBSR0 are latched and can be reset by a Read operation of the
register.
Table 42. Interrupt Mask Control Register 1 (IMR1)
Address
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
IMR1
$01D
R
HV
HTPW
MTPW
BATU
W
RESET
—
0
Table 43. Interrupt Mask Control Register 2 (IMR2)
Address
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
IMR2
$01E
R
BUSF
SPIE
WU
W
RESET
—
0
To enable the appropriate interrupt, the mask bit has to be set to 1. To disable the interrupt the bit, it must be cleared to 0. After a power-ON
reset or RST = Low, the bits are cleared to 0. All interrupts are disabled. Explanation for the abbreviations:
HV = VBAT High voltage
HT = High temperature on V1 or V2
MTPW = Medium temperature pre-warning on V1 or V2
BATU = Battery under voltage (BATFail)
BUSF = CAN bus failure
SPIE = SPI error
WU = Wake-up
Table 44. Interrupt Source Register 1 (ISR1)
Address
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
ISR
$021
R
HV
HTPW
MTPW
BATU
W
RESET
—
0
Table 45. Interrupt Source Register 2 (ISR2)
Address
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
ISR
$022
R
BUSF
SPIE
WU
W
RESET
—
0
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PDF描述 |
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参数描述 |
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