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参数资料
| 型号： | MC33889DPEGR2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 40/59页 |
| 文件大小： | 0K |
| 描述： | IC SYSTEM BASE W/CAN 28SOIC |
| 标准包装： | 1,000 |
| 系列： | * |
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Analog Integrated Circuit Device Data
Freescale Semiconductor
45
33889
FUNCTIONAL DEVICE OPERATION
LOGIC COMMANDS AND REGISTERS
Fault tolerant CAN transceiver extended modes
By setting CEXT to 1 the transceiver cell supports sub bus communication
Note: if DFIS bit is set to 1, WUR register must be read before going into sleep or stop mode in order to clear the wake-up flag.
During read out L0 must be at high level and should stay high when entering sleep or stop.
Comments:
CS2 bit at 0 = open failure. CS2 bit at 1 = short failure.
(CS3 bit at 0 and (CS1 = 1 or CS2 =1)) = CANH failure. CS3 bit at 1 = CANL failure.
CS1 and CS0 bits: short type failure coding (GND, VDD or VBAT).
In case of multiple failures, the last failure is reported.
.
Notes
34.
CEXT Bit should be set at 0. The CAN operation in extended mode is not recommended.
FDIS
L0 Wake Input Filter (20
s Typical)
0
Enable (LO wake threshold selectable by WUR register)
1
Disable (L0 wake-up threshold is low level only, no matter D0 and D1 bits set in WUR register).
Table 17. Status Bits
CS3
CS2
CS1
CS0
Bus failure #
Description
0
no failure
0
1
CANH open wire
0
1
0
1
5
CANH short circuit to
ground
0
1
0
8, 3a
VDD
0
1
3
VBAT
1
0
1
2
CANL open wire
1
0
1
4, 7
CANL short circuit to
ground / CANH
1
0
9
VDD
1
6
VBAT
Table 18. IOR Register
IOR
D3
D2
D1
D0
$011b
W
HS1ON
GSLR1
GSLR0
R
SHIFT
HS1OT
V2LOW
VSUPLOW
Reset
0
Reset condition
POR, RESET
Table 19. Control Bits
HS1ON
HS1
0
HS1 switch turn OFF
1
HS1 switch turn ON
Table 16. CAN Transceiver Extended Modes (CAN with CEXT bit =1 is not recommended)
CEXT (34)
CCTR1
CCTR0
Mode
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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