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参数资料
| 型号： | MC33912BAC |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 61/95页 |
| 文件大小： | 0K |
| 描述： | IC SYSTEM BASIS CHIP 32LQFP |
| 标准包装： | 250 |
| 应用： | 系统基础芯片 |
| 电流 - 电源： | 4.5mA |
| 电源电压： | 5.5 V ~ 27 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-LQFP |
| 供应商设备封装： | 32-LQFP（7x7） |
| 包装： | 托盘 |
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MC33912BAC / MC34912BAC
ELECTRICAL CHARACTERISTICS
DYNAMIC ELECTRICAL CHARACTERISTICS
DYNAMIC ELECTRICAL CHARACTERISTICS
Table 36. Dynamic Electrical Characteristics
Characteristics noted under conditions 5.5 V ?? V SUP ? 18 V, -40°C ? T A ? 125°C for the 33912 and -40°C ? T A ? 85°C for the
34912, unless otherwise noted. Typical values noted reflect the approximate parameter mean at T A = 25°C under nominal
conditions, unless otherwise noted.
Characteristic
Symbol
Min
Typ
Max
Unit
SPI Operating Frequency
SCLK Clock Period
SCLK Clock High Time (114)
SCLK Clock Low Time (114)
Falling Edge of CS to Rising Edge of SCLK (114)
Falling Edge of SCLK to CS Rising Edge (114)
MOSI to Falling Edge of SCLK (114)
Falling Edge of SCLK to MOSI (114)
f SPIOP
t PS CLK
t W SCLKH
t W SCLKL
t LEAD
t LAG
t SISU
t SIH
–
250
110
110
100
100
40
40
–
–
–
–
–
–
–
–
4.0
N/A
N/A
N/A
N/A
N/A
N/A
N/A
MHz
ns
ns
ns
ns
ns
ns
ns
MISO Rise Time (114)
t RSO
ns
C L = 220 pF
MISO Fall Time (114)
C L = 220 pF
Time from Falling or Rising Edges of CS to: (114)
t FSO
–
–
40
40
–
–
ns
ns
- MISO Low-impedance
- MISO High-impedance
t SOEN
t SODIS
0.0
0.0
–
–
50
50
Time from Rising Edge of SCLK to MISO Data Valid
0.2 x V DD ? MISO ? 0.8 x V DD , C L = 100 pF
t VALID
0.0
–
75
ns
RST OUTPUT PIN
Reset Deglitch Filter Time
t RST
t RSTDF
0.65
350
1.0
600
1.35
900
ms
ns
WINDOW WATCHDOG CONFIGURATION PIN (WDCONF)
Watchdog Time Period (115)
External Resistor R EXT = 20 k ? (1%)
External Resistor R EXT = 200 k ? (1%)
Without External Resistor R EXT (WDCONF Pin Open)
t PWD
8.5
79
110
10
94
150
11.5
108
205
ms
CURRENT SENSE AMPLIFIER
Common Mode Rejection Ratio
CMR
70
–
–
dB
Supply Voltage Rejection Ratio
Gain Bandwidth Product
Output Slew-rate
SVR
GBP
SR
60
0.75
0.5
–
3.0
–
–
–
–
dB
MHz
V/μs
Notes
114. This parameter is guaranteed by process monitoring but not production tested.
115. Watchdog timing period calculation formula: t PWD [ms] = 0.466 * (R EXT - 20) + 10 (R EXT in k ??
116.
Analog Outputs are supplied by V DD
33912
Analog Integrated Circuit Device Data ?
Freescale Semiconductor
61
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参数描述 |
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