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参数资料
| 型号： | MC56F8366VFVE |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 数字信号处理 |
| 英文描述： | 16-BIT, 120 MHz, OTHER DSP, PQFP144 |
| 封装： | ROHS COMPLIANT, LQFP-144 |
| 文件页数： | 38/182页 |
| 文件大小： | 1149K |
| 代理商： | MC56F8366VFVE |
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56F8366 Technical Data, Rev. 7
132
Freescale Semiconductor
Preliminary
6.5.11.2 CAN2 Enable—Bit 0
Each bit controls clocks to the indicated peripheral.
1 = Clocks are enabled
0 = The clock is not provided to the peripheral (the peripheral is disabled)
6.6 Clock Generation Overview
The SIM uses an internal master clock from the OCCS (CLKGEN) module to produce the peripheral and
system (core and memory) clocks. The maximum master clock frequency is 120MHz. Peripheral and
system clocks are generated at half the master clock frequency and therefore at a maximum 60MHz. The
SIM provides power modes (Stop, Wait) and clock enables (SIM_PCE register, CLK_DIS, ONCE_EBL)
to control which clocks are in operation. The OCCS, power modes, and clock enables provide a flexible
means to manage power consumption.
Power utilization can be minimized in several ways. In the OCCS, crystal oscillator, and PLL may be shut
down when not in use. When the PLL is in use, its prescaler and postscaler can be used to limit PLL and
master clock frequency. Power modes permit system and/or peripheral clocks to be disabled when unused.
Clock enables provide the means to disable individual clocks. Some peripherals provide further controls
to disable unused subfunctions. Refer to the Part 3 On-Chip Clock Synthesis (OCCS), and the 56F8300
Peripheral User Manual for further details.
6.7 Power-Down Modes Overview
The 56F8366/56F8166 devices operate in one of three power-down modes, as shown in Table 6-4
.
All peripherals, except the COP/watchdog timer, run off the IPbus clock frequency, which is the same as
the main processor frequency in this architecture. The maximum frequency of operation is
SYS_CLK = 60MHz.
Table 6-4 Clock Operation in Power-Down Modes
Mode
Core Clocks
Peripheral Clocks
Description
Run
Active
Device is fully functional
Wait
Core and memory
clocks disabled
Active
Peripherals are active and can product interrupts if they
have not been masked off.
Interrupts will cause the core to come out of its
suspended state and resume normal operation.
Typically used for power-conscious applications.
Stop
System clocks continue to be generated in
the SIM, but most are gated prior to
reaching memory, core and peripherals.
The only possible recoveries from Stop mode are:
1. CAN traffic (1st message will be lost)
2. Non-clocked interrupts
3. COP reset
4. External reset
5. Power-on reset
相关PDF资料 |
PDF描述 |
|---|---|
| MC56F8366VFV60 | 16-BIT, 120 MHz, OTHER DSP, PQFP144 |
| MC56F8335MFGE | 4-BIT, 120 MHz, OTHER DSP, PQFP128 |
| MC68008LC8 | 16-BIT, 8 MHz, MICROPROCESSOR, CDIP48 |
| MC68008L8 | 16-BIT, 8 MHz, MICROPROCESSOR, CDIP48 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| MC56F8367E | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:16-bit Digital Signal Controllers |
| MC56F8367EVM | 功能描述:开发板和工具包 - 其他处理器 MC56F8367 EVAL BOARD RoHS:否 制造商:Freescale Semiconductor 产品:Development Systems 工具用于评估:P3041 核心:e500mc 接口类型:I2C, SPI, USB 工作电源电压: |
| MC56F8367EVME | 功能描述:开发板和工具包 - 其他处理器 MC56F8367 EVALUATION BOARD RoHS:否 制造商:Freescale Semiconductor 产品:Development Systems 工具用于评估:P3041 核心:e500mc 接口类型:I2C, SPI, USB 工作电源电压: |
| MC56F8367EVME | 制造商:Freescale Semiconductor 功能描述:MC56F8367 EVALUATION BOA |
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