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参数资料
| 型号： | MC56F8366VFVE |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 数字信号处理 |
| 英文描述： | 16-BIT, 120 MHz, OTHER DSP, PQFP144 |
| 封装： | ROHS COMPLIANT, LQFP-144 |
| 文件页数： | 39/182页 |
| 文件大小： | 1149K |
| 代理商： | MC56F8366VFVE |
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Stop and Wait Mode Disable Function
56F8366 Technical Data, Rev. 7
Freescale Semiconductor
133
Preliminary
6.8 Stop and Wait Mode Disable Function
Figure 6-17 Internal Stop Disable Circuit
The 56800E core contains both STOP and WAIT instructions. Both put the CPU to sleep. For lowest
power consumption in Stop mode, the PLL can be shut down. This must be done explicitly before entering
Stop mode, since there is no automatic mechanism for this. When the PLL is shut down, the 56800E
system clock must be set equal to the prescaler output.
Some applications require the 56800E STOP and WAIT instructions be disabled. To disable those
instructions, write to the SIM control register (SIM_CONTROL) described in Part 6.5.1. This procedure
can be on either a permanent or temporary basis. Permanently assigned applications last only until their
next reset.
6.9 Resets
The SIM supports four sources of reset. The two asynchronous sources are the external RESET pin and
the Power-On Reset (POR). The two synchronous sources are the software reset, which is generated within
the SIM itself by writing to the SIM_CONTROL register, and the COP reset.
Reset begins with the assertion of any of the reset sources. Release of reset to various blocks is sequenced
to permit proper operation of the device. A POR reset is first extended for 221 clock cycles to permit
stabilization of the clock source, followed by a 32 clock window in which SIM clocking is initiated. It is
then followed by a 32 clock window in which peripherals are released to implement Flash security, and,
finally, followed by a 32 clock window in which the core is initialized. After completion of the described
reset sequence, application code will begin execution.
Resets may be asserted asynchronously, but they are always released internally on a rising edge of the
system clock.
D-FLOP
DQ
C
D-FLOP
D
Q
C
R
56800E
STOP_DIS
Permanent
Disable
Reprogrammable
Disable
Clock
Select
Reset
Note: Wait disable circuit is
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PDF描述 |
|---|---|
| MC56F8366VFV60 | 16-BIT, 120 MHz, OTHER DSP, PQFP144 |
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| MC68008LC8 | 16-BIT, 8 MHz, MICROPROCESSOR, CDIP48 |
| MC68008L8 | 16-BIT, 8 MHz, MICROPROCESSOR, CDIP48 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| MC56F8367 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:16-bit Digital Signal Controllers |
| MC56F8367E | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:16-bit Digital Signal Controllers |
| MC56F8367EVM | 功能描述:开发板和工具包 - 其他处理器 MC56F8367 EVAL BOARD RoHS:否 制造商:Freescale Semiconductor 产品:Development Systems 工具用于评估:P3041 核心:e500mc 接口类型:I2C, SPI, USB 工作电源电压: |
| MC56F8367EVME | 功能描述:开发板和工具包 - 其他处理器 MC56F8367 EVALUATION BOARD RoHS:否 制造商:Freescale Semiconductor 产品:Development Systems 工具用于评估:P3041 核心:e500mc 接口类型:I2C, SPI, USB 工作电源电压: |
| MC56F8367EVME | 制造商:Freescale Semiconductor 功能描述:MC56F8367 EVALUATION BOA |
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