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参数资料
| 型号： | MC68060RC50 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 50 MHz, MICROPROCESSOR, CPGA206 |
| 封装： | PGA-206 |
| 文件页数： | 145/418页 |
| 文件大小： | 1277K |
| 代理商： | MC68060RC50 |
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Bus Operation
7-74
M68060 USER’S MANUAL
MOTOROLA
7.14 SPECIAL MODES OF OPERATION
The MC68060 supports the following three operation modes, which are selectively enabled
during processor reset and remain in effect until the next processor reset. Refer to 7.13
Reset Operation for reset timing information. Table 7-10 summarizes the three special
modes and associates them with the appropriate IPLx signal.
7.14.1 Acknowledge Termination Ignore State Capability
The MC68060 provides acknowledge termination ignore state capability to make high-fre-
quency system design easier. This feature defines BCLK edges during which the acknowl-
edge termination signals (TA, TEA, and TRA) are ignored. This feature is enabled if IPL0 is
asserted during reset.
During reset, 16 bits of information (from D15–D0) are registered into the MC68060. These
16 bits define four values of four bits each. Two of the four values are used for read bus
cycles; the other two values are used for write bus cycles. For the read bus cycle, the first
value is the primary ignore state count value. The primary ignore state count value is used
during the first long-word transfer of a line transfer cycle, or the only data transfer for byte,
word, or long-word bus cycles. The second value is the secondary ignore state count value.
The secondary ignore state count value is used during the next three long words for line
transfer cycles, after the first long word has been transferred. Similarly, the two values of the
write bus cycle are defined as a primary ignore state count value and a secondary ignore
state count value, respectively. Figure 7-50 shows the assignment of the four data nibbles
at reset.
At the beginning of a bus cycle, the appropriate primary ignore state count value is loaded
into an internal counter. The counter decrements every BCLK rising edge. As long as the
counter has a non-zero count value, the MC68060 ignores the acknowledge termination sig-
nals. Once the counter reaches zero, the MC68060 asserts SAS for one BCLK period and
begins to sample the acknowledge termination signals and acts accordingly. For byte, word,
or long-word transfers, the bus cycle ends when a valid termination is detected. For line
transfer cycles after the first long-word transfer, the secondary ignore state count value is
Table 7-10. Special Mode vs. IPLx Signals
Signal
Value During
Reset Time
Action
IPL2
Asserted
Extra Data Write Hold Mode Enabled
Negated
Extra Data Write Hold Mode Disabled
IPL1
Asserted
Native-MC68060 Acknowledge Termination Protocol
Negated
MC68040 Acknowledge Termination Protocol
IPL0
Asserted
Acknowledge Termination Ignore State Capability Enabled
Negated
Acknowledge Termination Ignore State Capability Disabled
Figure 7-50. Data Bus Usage During Reset
15
12 11
3
87
4
0
READ PRIMARY
IGNORE STATE COUNT
READ SECONDARY
IGNORE STATE COUNT
WRITE PRIMARY
IGNORE STATE COUNT
WRITE SECONDARY
IGNORE STATE COUNT
相关PDF资料 |
PDF描述 |
|---|---|
| MC68A22L | 16 I/O, PIA-GENERAL PURPOSE, CDIP40 |
| M50734FP | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP72 |
| MC68HC811E2FN | EEPROM, MICROCONTROLLER, PQCC52 |
| MC68030RC33C | 32-BIT, 33.33 MHz, MICROPROCESSOR, CPGA128 |
| MDDFMM-TTL-100F | 100 MHz, OTHER CLOCK GENERATOR, PDIP4 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MC68060RC50 | 制造商:Freescale Semiconductor 功能描述:Microcontroller IC Clock Speed:50MHz |
| MC68060RC60 | 功能描述:微处理器 - MPU 32B W/ CACHE MMU FPU RoHS:否 制造商:Atmel 处理器系列:SAMA5D31 核心:ARM Cortex A5 数据总线宽度:32 bit 最大时钟频率:536 MHz 程序存储器大小:32 KB 数据 RAM 大小:128 KB 接口类型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作电源电压:1.8 V to 3.3 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-324 |
| MC6808 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:8-BIT MPUS, 8-BIT MCUS, 8-BIT PERIPHERALS |
| MC6809 | 制造商:MOTOROLA 制造商全称:Motorola, Inc 功能描述:8-Bit Microprocessing Unit |
| MC6809CP | 制造商:MOTOROLA 制造商全称:Motorola, Inc 功能描述:8-Bit Microprocessing Unit |
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