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参数资料
| 型号： | MC68HC05L5FU |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | MROM, 4.2 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | PLASTIC, QFP-80 |
| 文件页数： | 193/200页 |
| 文件大小： | 941K |
| 代理商： | MC68HC05L5FU |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页当前第193页第194页第195页第196页第197页第198页第199页第200页
NON-DISCLOSURE
AGREEMENT
REQUIRED
Oscillators/Clock Distributions
General Release Specification
MC68HC(7)05L5 — Rev. 2.0
92
Oscillators/Clock Distributions
MOTOROLA
7.5.2.2 XOSC with FOSCE = 0
If XOSC is the system clock, clearing FOSCE will stop OSC and preset
the 7-bit divider and 6-bit POR counter to $0078. Execution will continue
with XOSC and when FOSCE is set again, OSC will re-start. When the
POR counter overflows, FTUP is set, signaling that OSC is stable and
OSC can be used as the system clock. The stabilization time will be 8072
counts.
7.5.2.3 XOSC with FOSCE = 0 and STOP
If XOSC is the system clock and FOSCE is cleared, further power
reduction can be achieved by executing the STOP instruction. In this
case, OSC is stopped, the 7-bit divider and 6-bit POR counter are preset
to $0078 (since FOSCE = 0) and execution is halted. Exiting STOP with
external IRQ does not re-start the OSC; however, execution begins
immediately using XOSC. OSC may be re-started by setting FOSCE.
When the POR counter overflows, FTUP will be set, signaling that OSC
is stable and can be used as the system clock. The stabilization time will
be 8072 counts.
7.5.2.4 Stop Mode and Wait Mode
During stop mode, the main oscillator (OSC) is shut down and the clock
path from the second oscillator (XOSC) is disconnected. All modules
except timebase are halted. Entering stop mode clears the FTUP flag in
the MISC register and initializes the POR counter. Stop mode is exited
by RESET, IRQ1, IRQ2, KWI, SSPI (slave mode), or timebase interrupt.
If OSC is selected as the system clock source during stop mode, CPU
resumes after the overflow of the POR counter and this overflow also
sets the FTUP status flag.
If XOSC is selected as the system clock source during stop mode, no
stop recovery time is required for exiting stop mode because XOSC
never stops. Re-start of the main oscillator depends on the FOSCE bit.
During wait mode, only the CPU clocks are halted and the peripheral
modules are not affected. Wait mode is exited by RESET and any
interrupts.
F
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I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
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..
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相关PDF资料 |
PDF描述 |
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