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参数资料
| 型号： | MC68HC05L5FU |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | MROM, 4.2 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | PLASTIC, QFP-80 |
| 文件页数： | 197/200页 |
| 文件大小： | 941K |
| 代理商： | MC68HC05L5FU |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页当前第197页第198页第199页第200页
NON-DISCLOSURE
AGREEMENT
REQUIRED
Oscillators/Clock Distributions
General Release Specification
MC68HC(7)05L5 — Rev. 2.0
96
Oscillators/Clock Distributions
MOTOROLA
7.6.4 COP
The computer operating properly (COP) watchdog timer is controlled by
the COPE and COPC bits in the TBCR2 register.
The COP uses the same clock as TBI that is selected by the TBR1 and
TBR0 bits. The TBI is divided by four and overflow of this divider
generates COP timeout reset if the COP enable (COPE) bit is set. The
COP timeout reset has the same vector address as POR and external
RESET. To prevent the COP timeout, the COP divider is cleared by
writing a logic 1 to the COP clear (COPC) bit.
When the timebase divider is driven by the OSC clock, clock for the
divider is suspended during stop mode or when FOSCE is a logic 0. This
may cause COP period stretching or no COP timeout reset when
processing errors occur. To avoid these problems, it is recommended
that the XOSC clock be used for the COP functions.
When the timebase (COP) divider is driven by the XOSC clock, the
divider does not stop counting and the COPC bit must be triggered to
prevent the COP timeout.
Table 7-4. COP Timeout Period
TBCR2
COP Period (ms)
TBR1
TBR0
OSC = 4.0 MHz
OSC = 4.1943 MHz
XOSC = 32.768 kHz
Min
Max
Min
Max
Min
Max
0
12.3
16.4
11.7
15.6
11.7
15.6
0
1
393
524
375
500
375
500
1
0
786
1048
750
1000
750
1000
1
1573
2097
1500
2000
1500
2000
F
re
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sc
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S
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m
ic
o
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d
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c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相关PDF资料 |
PDF描述 |
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