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参数资料
| 型号： | MC68HC08RC16DW |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, MICROCONTROLLER, PDSO28 |
| 封装： | SOIC-28 |
| 文件页数： | 23/200页 |
| 文件大小： | 1856K |
| 代理商： | MC68HC08RC16DW |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页当前第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页
Carrier Modulator Transmitter (CMT)
Carrier Generator
MC68HC08RC16 — Rev. 1.0
Technical Data
MOTOROLA
Carrier Modulator Transmitter (CMT)
119
The MCGEN bit in the CMCS must be set and the BASE bit in the CMCS
must be cleared to enable carrier generator clocks. When the BASE bit
in the CMT modulator control and status register (CMCS) is set, the
carrier output to the modulator is held high continuously. The block
diagram is shown in Figure 12-3.
Figure 12-3. Carrier Generator Block Diagram
12.5.1 Time Counter
The high/low time counter is a 6-bit up counter. After each increment, the
contents of the counter are compared with the appropriate high or low
count value register. When the compare value is reached, the counter is
reset (to a value of 1) and the compare is redirected to the other count
value register.
Assuming that the high time count compare register is currently active,
a valid compare will cause the carrier output to be driven low. The
counter will continue to increment (starting at reset value of 1). When the
value stored in the selected low count value register is reached, the
counter will again be reset and the carrier output will be driven high.
CLK
6-BIT UP COUNTER
=?
CLR
CLOCK
AND
OUTPUT
CONTROL
PRIMARY HIGH COUNT REGISTER
SECONDARY HIGH COUNT REGISTER
PRIMARY/
SELECT
CARRIER OUT (fcg)
SECONDARY
MODULATOR/
CARRIER GENERATOR
ENABLE
PRIMARY LOW COUNT REGISTER
SECONDARY LOW COUNT REGISTER
CMTCLK
BASE
MODE
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