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参数资料
| 型号： | MC68HC08RC16DW |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, MICROCONTROLLER, PDSO28 |
| 封装： | SOIC-28 |
| 文件页数： | 80/200页 |
| 文件大小： | 1856K |
| 代理商： | MC68HC08RC16DW |
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Technical Data
MC68HC08RC16 — Rev. 1.0
170
Monitor ROM (MON)
MOTOROLA
Monitor ROM (MON)
17.4.1 Entering Monitor Mode
Table 17-1 shows the pin conditions for entering monitor mode.
If PTC3 is low upon monitor mode entry, CGMOUT is equal to the crystal
frequency. The bus frequency in this case is a divide-by-two of the input
clock. If PTC3 is high upon monitor mode entry, the bus frequency will
be a divide-by-four of the input clock.
NOTE:
Holding the PTC3 pin low when entering monitor mode causes a bypass
of a divide-by-two stage at the oscillator. The CGMOUT frequency is
equal to the CGMXCLK frequency, and the OSC1 input directly
generates internal bus clocks. In this case, the OSC1 signal must have
a 50 percent duty cycle at maximum bus frequency.
Enter monitor mode with the pin configuration shown above by pulling
RST low and then high. The rising edge of RST latches monitor mode.
Once monitor mode is latched, the values on the specified pins can
change.
NOTE:
The PTA7 pin must remain at logic 0 for 24 bus cycles after the RST pin
goes high.
Once out of reset, the MCU waits for the host to send eight security
bytes. (See 17.5 Security.) After the security bytes, the MCU sends a
break signal (10 consecutive logic 0s) to the host, indicating that it is
ready to receive a command.
Table 17-1. Monitor Mode Entry
IRQ1
Pin
PTA7
Pin
PTC1
Pin
PTC2
Pin
PTA0
Pin
PTC3
Pin
CGMOUT
Bus
Frequency
VTST
0101
1
0
CGMXCLK
2
-----------------------------
CGMOUT
2
--------------------------
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