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参数资料
| 型号： | MC68HC11A0CP3 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 3 MHz, MICROCONTROLLER, PDIP48 |
| 封装： | PLASTIC, DIP-48 |
| 文件页数： | 25/158页 |
| 文件大小： | 3803K |
| 代理商： | MC68HC11A0CP3 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页当前第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页
CPU, ADDRESSING MODES, AND INSTRUCTION SET
MC68HC11A8
10-22
TECHNICAL DATA
10
7-9
JSR
7
1
2
3
4
5
6
7
Opcode Address
Opcode Address + 1
Opcode Address + 2
$FFFF
(IY) + Offset
Stack Pointer
Stack Pointer – 1
1
0
Opcode (Page Select Byte)
($18)
Opcode (Second Byte) ($AD)
Index Offset
Irrelevant Data
First Opcode in Subroutine
Return Address (Low Byte)
Return Address (High Byte)
7-10
BCLR, BSET
8
1
2
3
4
5
6
7
8
Opcode Address
Opcode Address + 1
Opcode Address + 2
$FFFF
(IY) + Offset
Opcode Address + 3
$FFFF
(IY) + Offset
1
0
Opcode (Page Select Byte)
($18)
Opcode (Second Byte)
Index Offset
Irrelevant Data
Original Operand Data
Mask Byte
Irrelevant Data
Result Operand Data
7-11
BRCLR, BRSET
8
1
2
3
4
5
6
7
8
Opcode Address
Opcode Address + 1
Opcode Address + 2
$FFFF
(IY) + Offset
Opcode Address + 3
Opcode Address + 4
$FFFF
1
Opcode (Page Select Byte)
($18)
Opcode (Second Byte)
Index Offset
Irrelevant Data
Original Operand Data
Mask Byte
Branch Offset
Irrelevant Data
Table 10-8 Cycle-by-Cycle Operation — Relative Mode
Reference
Number*
Address Mode
and Instructions
Cycles Cycle
#
Address Bus
R/W
Line
Data Bus
8-1
BCC, BCS, BEQ,
BGE, BGT, BHI,
BHS, BLE, BLO,
BLS, BLT, BMI,
BNE, BPL, BRA,
BRN, BVC, BVS,
31
2
3
Opcode Address
Opcode Address + 1
$FFFF
1
Opcode
Branch Offset
Irrelevant Data
8-2
BSR
6
1
2
3
4
5
6
Opcode Address
Opcode Address + 1
$FFFF
Subroutine Address
Stack Pointer
Stack Pointer – 1
1
0
Opcode ($8D)
Branch Offset
Irrelevant Data
Opcode of Next Instruction
Return Address (Low Byte)
Return Address (High Byte)
*The reference number is given to provide a cross-reference to Table 10-1.
Table 10-7 Cycle-by-Cycle Operation — Indexed Y Mode (Sheet 2 of 2)
Reference
Number*
Address Mode
and Instructions
Cycles Cycle
#
Address Bus
R/W
Line
Data Bus
* The reference number is given to provide a cross-reference to Table 10-1.
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相关PDF资料 |
PDF描述 |
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参数描述 |
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| MC68HC11A0FN | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:ROM-based high-performance microcontrollers |
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