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参数资料
| 型号： | MC68HC11A0CP3 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 3 MHz, MICROCONTROLLER, PDIP48 |
| 封装： | PLASTIC, DIP-48 |
| 文件页数： | 45/158页 |
| 文件大小： | 3803K |
| 代理商： | MC68HC11A0CP3 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页当前第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页
ELECTRICAL CHARACTERISTICS
MOTOROLA
TECHNICAL DATA
A-19
A
NOTES:
1. Formula only for dc to 2 MHz.
2. Input clocks with duty cycles other than 50% affect bus performance. Timing parameters affected by input clock
duty cycle are identified by (a) and (b). To recalculate the approximate bus timing values, substitute the following
expressions in place of 1/8 tcyc in the above formulas, where applicable:
(a) (1-DC) x 1/4 tcyc
(b) DC x 1/4 tcyc
Where:
DC is the decimal value of duty cycle percentage (high time).
3. All timing is shown with respect to 20% VDD and 70% VDD, unless otherwise noted.
Table A-7 Expansion Bus Timing
VDD = 5.0 Vdc ± 10%, VSS = 0 Vdc, TA = TL to TH
Num
Characteristic
Symbol
1.0 MHz
2.0 MHz
3.0 MHz
Unit
Min
Max
Min
Max
Min
Max
Frequency of Operation (E-Clock Frequency)
fo
dc
1.0
dc
2.0
dc
3.0
MHz
1
Cycle Time
tcyc
1000
—
500
—
333
—
ns
2
Pulse Width, E Low
PWEL = 1/2 tcyc – 23 ns(Note 1)
PWEL
477
—
227
—
146
—
ns
3
Pulse Width, E High
PWEH = 1/2 tcyc – 28 ns(Note 1)
PWEH
472
—
222
—
141
—
ns
4a, b
E and AS Rise and Fall Time
tr
tf
—20
20
—20
20
—20
15
ns
9
Address Hold Time
tAH = 1/8 tcyc – 29.5 ns (Note 1, 2a)
tAH
95.5
—
33
—
26
—
ns
12
Non-Muxed Address Valid Time to E Rise
tAV = PWEL – (tASD + 80 ns)(Note 1, 2a)
tAV
281.5
—
94
—
54
—
ns
17
Read Data Setup Time
tDSR
30—30—30—
ns
18
Read Data Hold Time (Max = tMAD)tDHR
0
145.5
0
83
0
51
ns
19
Write Data Delay Time
tDDW = 1/8 tcyc + 65.5 ns (Note 1, 2a)
tDDW
—
190.5
—
128
—
71
ns
21
Write Data Hold Time
tDHW = 1/8 tcyc – 29.5 ns(Note 1, 2a)
tDHW
95.5
—
33
—
26
—
ns
22
Muxed Address Valid Time to E Rise
tAVM = PWEL – (tASD + 90 ns)(Note 1, 2a)
tAVM
271.5
—
84
—
54
—
ns
24
Muxed Address Valid Time to AS Fall
tASL = PWASH – 70 ns(Note 1)
tASL
151
—26—13—
ns
25
Muxed Address Hold Time
tAHL = 1/8 tcyc – 29.5 ns(Note 1, 2b)
tAHL
95.5
—
33
—
31
—
ns
26
Delay Time, E to AS Rise
tASD = 1/8 tcyc – 9.5 ns (Note 1, 2a)
tASD
115.5
—
53
—
31
—
ns
27
Pulse Width, AS High
PWASH = 1/4 tcyc – 29 ns(Note 1)
PWASH
221
—96—63—
ns
28
Delay Time, AS to E Rise
tASED = 1/8 tcyc – 9.5 ns(Note 1, 2b)
tASED
115.5
—
53
—
31
—
ns
29
MPU Address Access Time(Note 2a)
tACCA = tcyc – (PWEL – tAVM) – tDSR – tf
tACCA
744.5
—
307
—
196
—
ns
35
MPU Access Time
tACCE = PWEH – tDSR
tACCE
—
442
—
192
—
111
ns
36
Muxed Address Delay
(Previous Cycle MPU Read)
tMAD = tASD + 30 ns(Note 1, 2a)
tMAD
145.5
—
83
—
51
—
ns
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相关PDF资料 |
PDF描述 |
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