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参数资料
| 型号： | MC68HC705E5P |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PDIP28 |
| 封装： | PLASTIC, DIP-28 |
| 文件页数： | 140/148页 |
| 文件大小： | 3554K |
| 代理商： | MC68HC705E5P |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页当前第140页第141页第142页第143页第144页第145页第146页第147页第148页
Motorola Bus (M Bus) Interface
Programming Considerations
MC68HC705E5 — Rev. 1.0
General Release Specification
Motorola Bus (M Bus) Interface
NON-DISCLOSURE
AGREEMENT
REQUIRED
11.8.4 Generation of the Stop Signal
A data transfer ends with a stop signal generated by the master device.
A master transmitter can simply generate a stop signal after all the data
has been transmitted.
The following is an example showing how a stop condition is generated
by a master transmitter.
MASTX
BRSET
0,MSR,END
; IF NO ACK, BRANCH TO END
LDA
TXCNT
; GET VALUE FROM THE
; TRANSMITTING COUNTER
BEQ
END
; IF NO MORE DATA, BRANCH TO
; END
LDA
DATABUF
; GET NEXT BYTE OF DATA
STA
MDR
; TRANSMIT THE DATA
DEC
TXCNT
; DECREASE THE TXCNT
BRA
EMASTX
; EXIT
END
BCLR
5,MCR
; GENERATE A STOP CONDITION
EMASTX
RTI
; RETURN FROM INTERRUPT
If a master receiver wants to terminate a data transfer, it must inform the
slave transmitter by not acknowledging the last byte of data. This can be
done by setting the transmit acknowledge bit (TXAK) before reading the
second to the last byte of data. Before reading the last byte of data, a
stop signal must be generated first.
The following is an example showing how a stop signal is generated by
a master receiver.
MASR
DEC
RXCNT
BEQ
ENMASR
; LAST BYTE TO BE READ
LDA
RXCNT
DECA
; CHECK LAST 2ND BYTE TO BE READ
BNE
NXMAR
; NOT LAST ONE OR LAST SECOND
LAMAR
BSET
3,MCR
; LAST SECOND, DISABLE ACK
; TRANSMITTING
BRA
NXMAR
ENMASR
BCLR
5,MCR
; LAST ONE, GENERATE 'STOP'
; SIGNAL
NXMAR
LDA
MDR
; READ DATA AND STORE
STA
RXBUF
RTI
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相关PDF资料 |
PDF描述 |
|---|---|
| MC68HC705F32CPU | 8-BIT, OTPROM, 1.789 MHz, MICROCONTROLLER, PQFP100 |
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| MC68HC705F32FU | 8-BIT, OTPROM, 1.789 MHz, MICROCONTROLLER, PQFP80 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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