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参数资料
| 型号： | MC68HC705E6MFB |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | PLASTIC, QFP-44 |
| 文件页数： | 52/140页 |
| 文件大小： | 1584K |
| 代理商： | MC68HC705E6MFB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页当前第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页
Modes of Operation and Pin Descriptions
Pin descriptions
MC68HC05E6 — Rev. 1.0
Modes of Operation and Pin Descriptions
7-pin
Ceramic
resonator
A ceramic resonator may be used instead of a crystal in cost sensitive
applications. The circuit shown in Figure 5(a) is recommended when
using either a crystal or a ceramic resonator. Figure 5(e) lists the
recommended capacitance and feedback resistance values. The
manufacturer of the particular ceramic resonator being considered
should be consulted for specific information.
External clock
An external clock should be applied to the OSC1 input, with the OSC2
(see Table 23) does not apply when using an external clock input. The
equivalent specification of the external clock source should be used in
lieu of tOCOV.
LVI
This active low input pin is used to indicate a drop in supply voltage
below a useful operating level. Driving this pin low initiates either a
pre-defined software routine or a hardware interrupt (see Low voltage
indicator interrupt). The LVI pin contains an internal Schmitt trigger to
improve noise immunity.
RESET
This active low input-only pin is used to reset the MCU. Applying a logic
zero to this pin forces the device to a known start-up state. The RESET
pin has an internal Schmitt trigger to improve noise immunity.
PA0PA7
These eight I/O lines comprise port A. The state of any pin is software
programmable, and all the pins are configured as inputs with fixed
pull-up resistors during power-on or reset.
PB0PB7
These eight pins comprise port B. The state of any pin is software
programmable, and all the pins are configured as inputs with fixed
pull-down resistors during power-on or reset.
NOTE:
PB5–PB7 are not bonded out in the 28-pin package.
F
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c
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r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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