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参数资料
| 型号： | MC68HC705JB2P |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 3 MHz, MICROCONTROLLER, PDIP20 |
| 封装： | PLASTIC, DIP-20 |
| 文件页数： | 75/128页 |
| 文件大小： | 2493K |
| 代理商： | MC68HC705JB2P |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页当前第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页
GENERAL RELEASE SPECIFICATION
August 28, 1998
INPUT/OUTPUT PORTS
MC68HC705JB2
7-4
REV 1.1
7.2
PORT B
Port B is a 3-bit bidirectional port which functions as shown in Figure 7-2. Each
Port B pin is controlled by the corresponding bits in a data direction register, a
data register, and a pulldown/up register. The Port B Data Register is located at
address $0001. The Port B Data Direction Register (DDRB) is located at address
$0005. The Port B Pulldown/up Register (PDURB) is located at address $0011.
Reset clears the DDRB and the PDURB. The Port B Data Register is unaffected
by reset.
PB0 is a standard push-pull I/O pin with pulldown option; and is shared with TCAP.
PB1 and PB2 are of open-drain type, with pullup option, each capable of sinking
25mA (typical) current at VOL 0.5V max. These two pins may be connected
together to constitute a single pin capable of sinking 50mA (typical). In this case,
both PB1 and PB2 data bits will have to be written with the same value at the
same write cycle.
Figure 7-2. Port B I/O Circuitry
7.2.1 Port B Data Register
All Port B I/O pins have a corresponding bit in the Port B Data Register. When a
Port B pin is programmed as an output the state of the corresponding data
register bit determines the state of the output pin. When a Port B pin is
programmed as an input, any read of the Port B Data Register will return the logic
state of the corresponding I/O pin. The Port B data register is unaffected by reset.
Unused bits will always read as logic zeros, and any write to these bits will be
ignored. The Port B data register is unaffected by reset.
Write $0011
Read $0001
Write $0001
Read $0005
Write $0005
Internal HC05
Data Bus
100
A
Pulldown
Data
Register Bit
Output
Mask Option
(Software Pulldown/up Inhibit)
Reset
(RST)
Data Direction
Register Bit
Pulldown/up
Register Bit
VDD
100K
Pullup
Note: Each I/O port pin can have either pullup or pulldown device, but not both.
PB1 and PB2 output drivers are of open-drain type
I/O Pin
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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